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  1. MAX Pool Code

    1下载:
  2. This is the verilog code for max pooling method.
  3. 所属分类:VHDL编程

    • 发布日期:2024-01-17
    • 文件大小:1496
    • 提供者:2301*****
  1. 基于FPGA的频率计设计源码

    1下载:
  2. 频率计设计,FPGA实现纯逻辑等精度频率计设计,功能调试通过。亲测好用。
  3. 所属分类:VHDL编程

    • 发布日期:2023-12-30
    • 文件大小:49628440
    • 提供者:阿Q不再画圆
  1. 1588接收解析代码

    1下载:
  2. 基于verilog的1588 V2协议解析的代码
  3. 所属分类:VHDL编程

  1. 地铁站售货机源代码

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  2. 基本售货机源代码,实现了选择货物,投币检测,找零等基础的功能,里面有详细的注释说明。
  3. 所属分类:VHDL编程

  1. bch

    1下载:
  2. bch codec verilog,可以作为初学者参考
  3. 所属分类:VHDL编程

  1. FPGA designer

    0下载:
  2. 一个LED闪烁程序,使用计数器方式呈现,以第25位作为标志位,控制LED闪烁
  3. 所属分类:VHDL编程

  1. scrambler

    0下载:
  2. 通讯领域很多对原始数据进行加饶,加饶的多项式可以有很多种。上面是一种实现,可以参考实现其它加饶的多项式, 同理如果实现解扰可以反过来
  3. 所属分类:VHDL编程

    • 发布日期:2022-09-07
    • 文件大小:907
    • 提供者:Jack@Chen
  1. SSP_PL022-REL1V0

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  2. SSP_PL022-REL1V0.zip
  3. 所属分类:VHDL编程

    • 发布日期:2022-07-23
    • 文件大小:1005231
    • 提供者:perst@sadsa.com
  1. all_use.rar

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  2. all_use.rar
  3. 所属分类:VHDL编程

    • 发布日期:2022-07-07
    • 文件大小:1779524
    • 提供者:coolhandy
  1. simple_spi_latest.tar.gz

    0下载:
  2. simple_spi_latest.tar.gz
  3. 所属分类:VHDL编程

    • 发布日期:2022-06-01
    • 文件大小:575399
    • 提供者:coolhandy
  1. mux21

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  2. 多路选择器的设计代码及仿真验证,还有激励文件。
  3. 所属分类:VHDL编程

  1. 串口接收程序

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  2. 异步串口接收程序,主要功能是将异步串口转换成8位并口数据,数据格式为8位数据、1个停止位、1个停止位、无校验位,可以自行设置波特率。
  3. 所属分类:VHDL编程

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