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  1. vhdl实现异步fifo

    0下载：
  2. 使用vhdl实现异步fifo功能，不占用ram资源，仅占用少量LE资源，且读写计数进行了格雷码转换，使用安全

  3. 所属分类：VHDL编程

  1. sram_ctr

    1下载：
  2. SRAM VERILOG 实现FPGA控制SRAM的功能。测试可以使用。(SRAM verilog fpga vivado ise quartus.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2020-09-25
    • 文件大小：1024
    • 提供者：hwz

  1. AM调制解调

    1下载：
  2. 基于Artix-7 FPGA的AM调制解调代码，从AD读入信号后，进行AM调制，并解调输出（将代码分成两个工程就是AM的调制和解调），其中解调用到的数字滤波采用MATLAB设计(The AM modulation and demodulation code based on artix-7 FPGA, after reading the signal from AD, carries out AM modulation, and demodulates the output (the code

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2021-04-20
    • 文件大小：41027584
    • 提供者：Emmanuel000

  1. 01_router_lab_all

    1下载：
  2. 基于UVM平台搭建的验证环境，针对的是路由器router模块，可供参考(The verification environment based on UVM platform aims at router module of router, which can be used for reference)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2020-11-13
    • 文件大小：30720
    • 提供者：迪哥

  1. apbi2c-master

    7下载：
  2. apb转i2c verilog 实现(APB bus interface to I2C bus interface)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2021-01-15
    • 文件大小：445440
    • 提供者：AyanamiC

  1. LVDS

    4下载：
  2. 实现了LVDS的发送和接收，本例程增加了握手信号实现，没有用serdes(The sending and receiving of LVDS are realized)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2021-02-19
    • 文件大小：4096
    • 提供者：E=MC2

  1. BR262降噪芯片寄存器设置

    0下载：
  2. 针对BR262器件的寄存器控制，可设置增益大小，数字接口，模拟接口输出等功能

  3. 所属分类：VHDL编程

  1. 矩阵键盘检测电路

    0下载：
  2. 基于FPGA实现矩阵键盘输入键值的检测、防抖、移位和显示等功能。

  3. 所属分类：VHDL编程

  1. 投币充电仪

    1下载：
  2. 基于FPGA的投币式充电仪，可以完成按键输入、倒计时、清零等功能。

  3. 所属分类：VHDL编程

  1. 2D的DCT变换

    1下载：
  2. 二维DCT变换，附源码以及testbench，以及相应的数学知识

  3. 所属分类：VHDL编程

  1. 通用异步收发器

    1下载：
  2. 用Verilog编写的uart通用异步收发器带testbench

  3. 所属分类：VHDL编程

  1. 基于DSP和FPGA的通用数字信号处理系统设计

    1下载：
  2. 利用DSP配合FPGA为硬件架构，以DSP为数据处理核心，通过FPGA对USB、ADC和DAC等外围设备进行控制，并可实现频谱分析、数字滤波器等数字信号处理算法。(With DSP and FPGA as the hardware architecture and DSP as the data processing core, the peripheral devices such as USB, ADC and DAC are controlled by FPGA, and the digi

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2021-01-14
    • 文件大小：688128
    • 提供者：小冰2
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