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cyclone3_handbook
- Altera 公司生产的FPGA系列中的低端高性能产品cyclone三代用户手册,这个也能从Altera官方网站上下载。-Altera' s FPGA series production of high-performance products cyclone three generations of low-end user manuals, this is also downloaded from the Altera website.
LED
- 本设计运用了基于 Nios II 嵌入式处理器的 SOPC 技术。系统以 ALTERA 公司的 Cyclone II 系列 FPGA 为数字平台，将微处理器、Avalon 总线、LED 点阵扫描控制器、存储器和人机接口控制器等硬件设备集中在一片 FPGA 上，利用片内硬件来实现 LED 点阵的带地址扫描，降低系统总功耗和简化 CPU 编程的同时，提高了系统的精确度、稳定性和抗干扰性能。-This design used the Nios II embedded processor based o
testbench
- altera 最新的CYCLONE IV的pci-e核的testbench，VHDL源程序。-altera latest CYCLONE IV of the pci-e core testbench, VHDL source code.
DE2_TV
- 友晶公司DE2开发板的TV示例完整源代码 FPGA Cyclone-Friends of the crystal of TV company DE2 development board complete source code for FPGA CycloneII sample
cycloneiii_sb_3c25
- 这是ALTERA 公司Cyclone III的Cyclone III的EP3C25的原理图，对于学习FPGA有很大的帮助。-It is very usefull to learner,which learn Cyclone III-EP3C25,It could help you more easier escape it!
Altera-CycloneII
- Protel99库_ALTERA Cyclone-Library _ALTERA CycloneII Protel99
FPGA
- 本文采用FPGA来模拟实际的乒乓球游戏。本设计是基于Altera 公司的FPGA Cyclone II 芯片EP2C35 的基础上实现，运用Verilog HDL 语言编程，Quartus II 软件上进行编译、仿真，最终在Altera 公司的DE2 开发板上成功实现下载和调试-In this paper, FPGA to simulate the actual tennis game. The design is based on Altera' s FPGA Cyclone II EP
Altera_Cyclone_III
- Protel99库 Altera_Cyclone_-Protel99 Library Altera_Cyclone_III
ep1c6P80c52
- Altera FPGA cyclone EP1C6 + 80C52 实验板原理图-Altera FPGA cyclone EP1C6+ 80C52 Experiment Board Schematic
hw5
- Design a 2-digit stopwatch that ticks every second. A switch is used to start and stop the time. When the switch is pushed, the time will start and when it is pushed again, the time will stop. In order for the switch to work properly, the switch must
digi_clock
- 用verilog写的数字钟程序，已在altera公司的cyclone IV开发板上运行成功，很有价值-Digital clock using verilog written procedures for the company in altera cyclone IV development board to run a successful, valuable
DE2_NET
- altera cyclone 2 net example
cyclone-handbook
- altera 的cyclone fpga手册，比较全面介绍了这款fpga芯片-the cyclone handbook of altera s fpga，specifically introduced this fpga chip
weitb
- 在数字通信中，通常直接从接收到的数字信号中提取位同步信号，这种直接法按其提取同步信号的方式，大致可分为滤波法和锁相法。锁相法是指利用锁相环来提取位同步信号的方法，本设计方案就是基于锁相环的位同步提取方法，能够比较快速地提取位同步时钟，并且设计简单，方便修改参数。采用Quartus II设计软件对系统进行了仿真试验，并用Altera的Cyclone II系列FPGA芯片Ep2c5予以实现。-In digital communication, usually from receiving direc
MYCRC
- 由于altera公司的CRC生成和校验模块不支持本系统使用的Cyclone IV E系列FPGA，因此本文独立设计了CRC模块。该模块的接口与altera公司的CRC模块接口基本一致，能够对16位输入的数据流进行CRC校验码生成和校验。本文采用CRC-CCITT生成项，其表达式为：X16+X12+X5+X0。本模块需要startp信号及endp信号指示数据传输的起始及结束。本模块采用状态机设计，对于数据头和数据尾分别由不同的状态来处理。在本模块中，使用了for循环，这会消耗较多的FPGA资源，但
EP3C120-LCD
- 应用verilog语言编写的在ALTERA-CYCLONE III 开发板1602上面显示字符-Application verilog language characters shown above in 1602
procesador_2
- Processor in VHDL creating by us for Altera Cyclone II FPGA
DDR_CTRL
- DDR Verilog 控制器，quartus 10.1工程。适用Altera Cyclone® III starter board-DDR control quatrus 10.1，Altera Cyclone® III starter board
mc8051_cyclone_nios
- mc8051 v1.4 oregano VHDL core for the Altera Cyclone Nios evaluation board.
spi
- Altera Cyclone SPI-slave vhdl module