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搜索资源列表

  1. avr-charger

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  2. AVR官方充电器设计C源码,CPU为AT90S4333,源码包括头文件,定义电池类型,电压,容量和电压单位数值,主程序,所有电池类型等。-AVR C source code official charger design, CPU is AT90S4333, including the header file source, define the battery type, voltage, capacity and voltage unit values, the main program,
  3. 所属分类:SCM

    • 发布日期:2017-04-09
    • 文件大小:1553310
    • 提供者:蒋贵良
  1. SAM_CPU_IC

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  2. 于SAM模块的CPU型IC卡燃气表的设计-CPU module based on the SAM IC card gas meter design
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:146265
    • 提供者:张明利
  1. A-RISC-Design

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  2. RISC设计:MIPS指令集控制器核,详细介绍一款32位risc-cpu。-A RISC Design:Synthesis of the MIPS Processor Core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1130462
    • 提供者:梁梁
  1. chengxu

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  2. AT89S52 单片机做CPU处理器处理控制,使用 DS18B20 集成温度传感器采集温度数据,七段数码管做显示,可以显示当前的温度值,并且可以设定一个上限温度值并保存在 DS18B20 中,可以调节所要限定的温度值。还设计了一路继电器控制,超出设定温度时继电器被驱动吸合,外电路中的降温风扇开始工作并发出警报,温度低于设定温度后,继电器自动断开风扇停止工作,警报解除。这样就形成了一个反馈系统。-The Adjustable temperature controller
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-07
    • 文件大小:3587
    • 提供者:陈灌灌
  1. fpga-display-bmp-pictures

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  2. 本文设计的是基于大规模FPGA的BMP图库管理,完成了数码相框的一部分功能。并且本文详细地介绍了BMP图库管理的软硬件实现,即采用Altera的CyclonII系列EP2C20F484C7作为主控芯片,内嵌32位的NiosII软核,采用SDRAM作为内存,把存储在SD卡内的二进制图片信息读入内存,并控制TFT彩色液晶,读取图片数据送到液晶上显示。整个过程的所有设备都是通过Avalon总线挂在NiosII上,在NiosII的协调下正常工作。 本作品最终能显示存入SD卡内的彩色图片信息,图
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-06-07
    • 文件大小:2168832
    • 提供者:wuwei
  1. DE1_fat32

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  2. 本文设计的是基于大规模FPGA的BMP图库管理,完成了数码相框的一部分功能。并且本文详细地介绍了BMP图库管理的软硬件实现,即采用Altera的CyclonII系列EP2C20F484C7作为主控芯片,内嵌32位的NiosII软核,采用SDRAM作为内存,把存储在SD卡内的二进制图片信息读入内存,并控制TFT彩色液晶,读取图片数据送到液晶上显示。整个过程的所有设备都是通过Avalon总线挂在NiosII上,在NiosII的协调下正常工作。 本作品最终能显示存入SD卡内的彩色图片信息,图
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-11
    • 文件大小:11721728
    • 提供者:wuwei
  1. SigCylCPU

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  2. 单周期cpu的设计实现在VHDL中的verilog中实现。 -Design and implementation of single-cycle cpu in VHDL to implement the verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3954543
    • 提供者:钟金成
  1. exp7_final

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  2. CPU流水线设计 实现旁路 停顿 和 控制竞争处理 源代码-CPU pipeline design and control of competition to achieve bypass stop processing the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3154860
    • 提供者:crystal
  1. Waveform-Generator-Based-on-AT89S52

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  2. 该设计使用的是AT89S52单片机构成的波形发生器,AT89S52是一个低功耗,高性能CMOS 8位单片机,片内含4k Bytes ISP(In-system programmable)的可反复擦写1000次的Flash只读程序存储器,器件采用ATMEL公司的高密度、非易失性存储技术制造,兼容标准MCS-51指令系统及80C51引脚结构,芯片内集成了通用8位中央处理器和ISP Flash存储单元,功能强大的微型计算机的AT89S52可为许多嵌入式控制应用系统提供高性价比的解决方案。所以利用其产生
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:435302
    • 提供者:gaojiwei
  1. me-lift-arm-32

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  2. me-lift-arm 32位电梯控制系统手册性能特点 3.2.1.1 FREESCALE 工业级32 位CPU,独特锁相环技术,降低CPU 外部频率,极大的提高系统的抗干力。 3.2.1.2 四层电路板表贴工艺,性能稳定可靠,抗干扰能力强。3 路CAN 总线串行通讯,一路用于外呼、 轿内通讯;一路用于并联群控通讯;一路用于远程监控和小区监控通讯。 3.2.1.3 高智能优化设计,菜单操作液晶显示,使调试更为简单。-me-lift-arm 32 位 manual elevator
  3. 所属分类:File Formats

    • 发布日期:2017-05-17
    • 文件大小:4680566
    • 提供者:夜路
  1. dandaopichuli

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  2. 为单道批处理系统设计一个作业调度程序。 由于在单道批处理系统中,作业一投入运行,它就占有计算机的一切资源直到作业完成为止,因此调度作业时不必考虑它所需要的资源是否得到满足,它所占用的 CPU时限等因素。 作业调度算法:①采用先来先服务(FCFS)调度算法 ②最短作业优先算法 ③响应比高者优先调度算法。 每个作业由一个作业控制块JCB表示,JCB可以包含如下信息:作业名、提交时间、所需的运行时间、所需的资源、作业状态、链指针等等。作业的状态可以是等待W(Wait)、运行R(Run)和完成F
  3. 所属分类:Project Design

    • 发布日期:2017-04-05
    • 文件大小:653179
    • 提供者:杨晶
  1. Linux-driver-development15

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  2. 作者:华清远见嵌入式学院。《Linux设备驱动开发详解》(08&09年度畅销榜TOP50)第15章、Linux的I2C核心、总线与设备驱动。I2C总线仅仅使用SCL、SDA这两根信号线就实现了设备之间的数据交互,极大地简化了对硬件资源和PCB板布线空间的占用。因此,I2C总线被非常广泛地应用在EEPROM、实时钟、小型LCD等设备与CPU的接口中。Linux系统定义了I2C驱动体系结构,在Linux系统中,I2C驱动由3部分组成,即I2C核心、I2C总线驱动和I2C设备驱动。这3部分相互协作,形
  3. 所属分类:Linux-Unix program

    • 发布日期:2017-03-23
    • 文件大小:593783
    • 提供者:华清远见
  1. Linux-driver-development2

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  2. 作者:华清远见嵌入式学院。《Linux设备驱动开发详解》(08&09年度畅销榜TOP50)第2章、驱动设计的硬件基础。本章讲解底层驱动工程师必备的硬件基础,给出了嵌入式系统硬件原理及分析方法的全景视图。2.1节讲解微控制器、微处理器、数字信号处理器以及应用于特定领域的处理器各自的特点。2.2节对嵌入式系统中所使用的各类存储器与CPU的接口、应用领域及特点进行了详细讲解。2.3节讲解常见的外设接口与总线的工作方式,包括串口、I2C、USB、以太网接口、ISA、PCI和cPCI等。嵌入式系统硬件电路
  3. 所属分类:Linux-Unix program

    • 发布日期:2017-03-29
    • 文件大小:866709
    • 提供者:华清远见
  1. 95637012Multiplier

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  2. 一种可以完成16位有符号/无符号二进制数乘法的乘法器。该乘法器采用了改进的booth算法,简化了部分积的符号扩展,采用Wallace树和超前进位加法器来进一步提高电路的运算速度。本乘法器可以作为嵌入式CPU内核的乘法单元,整个设计用VHDL语言实现。- This file contains all the entity-architectures for a complete-- k-bit x k-bit Booth multiplier.-- the design makes use of
  3. 所属分类:Algorithm

    • 发布日期:2017-04-17
    • 文件大小:358142
    • 提供者:zhou
  1. AVR_Core

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  2. AVR 单片机内核处理器vhdl代码,用fpga设计的avr cpu核,主要供fpga学习者参考用-AVR microcontroller core processor vhdl code, using fpga design avr cpu core, the main reference for learners fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:71058
    • 提供者:lixinping
  1. 213243545

    0下载:
  2. (1)定义一个CPU类,包含等级(rank)、频率(frequency)、电压(voltage)等属性,有两个公有成员函数run、stop,其中rank为枚举类型CPU_ Rank,定义为enum CPU_ Rank(P1 = 1,P2,P3,P4,P5,P6,P7),frequency为单位是MHz的整型数,voltage为浮点型的电压值。观察构造函数和析构函数的调用顺序。 (2)定义一个简单的Computer类,有数据成员芯片(CPU),内存(ram),光驱(cdrom)等等,有两个公有
  3. 所属分类:software engineering

    • 发布日期:2017-04-26
    • 文件大小:24388
    • 提供者:liangjie
  1. 123

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  2. ----曾经有一段真挚的代码放在我的公司电脑里,但我却没能带回家(因为公司的电脑把USB口封了),尘世间最郁闷的事情 莫过于此,如果上天愿意给我一个机会,我会对自己说,把代码带回家吧,如果一定要给一个容量,我希望是:1万G! 辛勤地打工的工程师们,你们是否曾经有过或者你们的朋友有过这样的经历,自己辛辛苦苦为公司写的代码和设计的PCB,却无 论如何都不能据为己有?因为公司不允许个人电脑上网,因为公司的电脑居然吧USB口封闭了!!!这时候,我们是万般地郁 闷,但是
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-17
    • 文件大小:472979
    • 提供者:f
  1. VxWorks-the-system-board

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  2. 本文为中国科学院知识创新项目天基综合信息网预研项 目的一部分,为未来天基网的星载设备研制一个具有中等处 理能力、高可靠的通用计算机平台。其硬件核心为386EX CPU,软件的核心部分采用美国Windriver公司的VxWorks实 时多任务操作系统。采用操作系统的最大优势是便于软件的 开发,使软件的可重用性、可维护性大为提高,从而整体上 提高软件的可靠性。VxWorks是一个优秀的操作系统,采用 微内核结构,可裁减至几万字节,对于嵌入式系统非常合 适。同时VxWo
  3. 所属分类:VxWorks

    • 发布日期:2017-03-27
    • 文件大小:24465
    • 提供者:黑雾
  1. uCOS-II

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  2. μC/OS-II是一种可移植的,可植入ROM的,可裁剪的,抢占式的,实时多任务操作系统内核。它被广泛应用于微处理器、微控制器和数字信号处理器。 μC/OS 和μC/OS-II 是专门为计算机的嵌入式应用设计的, 绝大部分代码是用C语言编写的。CPU 硬件相关部分是用汇编语言编写的、总量约200行的汇编语言部分被压缩到最低限度,为的是便于移植到任何一种其它的CPU 上。用户只要有标准的ANSI 的C交叉编译器,有汇编器、连接器等软件工具,就可以将μC/OS-II嵌入到开发的产品中。μC/OS-
  3. 所属分类:uCOS

    • 发布日期:2017-04-16
    • 文件大小:120632
    • 提供者:chr
  1. POC

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  2. 该项目是设计和模拟一个并行输出控制器,作为系统总线和打印机之间的接口。-An I/O module is the entity within a computer responsible for the control of one or more external devices and for the exchange of data between those devices and main memory and CPU registers. Thus, the I/O module a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1776281
    • 提供者:李楠
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