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搜索资源列表

  1. CPU

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  2. Simple 8 bit ALU which subs, adds, ands, ors, nots, ...
  3. 所属分类:SCM

    • 发布日期:2017-03-27
    • 文件大小:2899
    • 提供者:Emrah
  1. cpu

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  2. nios处理器代码,基于VHDL语言,很难道-nios processor code,vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:41847
    • 提供者:丁丁
  1. cpu

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  2. 用全加器设计8位运算器逻辑电路图 2、根据逻辑电路用 VHDL编程实现 3、调试编译通过后,仿真 -this file can help you learn the design of cpu
  3. 所属分类:matlab

    • 发布日期:2017-03-25
    • 文件大小:247886
    • 提供者:linxiaoxuan
  1. ESAM_CARD

    0下载:
  2. CPU卡程序 已经在电表应用 性能良好 适合国网要求的协议-CPU card procedures have been well-suited to the meter application performance requirements of an agreement State Grid
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:6118
    • 提供者:taxiangren80
  1. mipscpu-source

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  2. mips cpu的实现.MIPS是世界上很流行的一种RISC处理器。MIPS公司的R系列就是在此基础上开发的RISC工业产品的微处理器。这些系列产品为很多计算机公司采用构成各种工作站和计算 机系统。 -mips cpu implementation. MIPS is the world' s very popular as a RISC processor. MIPS company' s R series is based on the development of industr
  3. 所属分类:Windows Develop

    • 发布日期:2017-05-22
    • 文件大小:7025256
    • 提供者:汤龑鸣
  1. Microprogramcontroller

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  2. 微程序控制器部件实验,使用VHDL语言使用Quartus测试通过,模拟CPU-Micro-program controller component experiments, the use of VHDL language use Quartus test, simulation CPU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:753045
    • 提供者:糖糖
  1. CPU

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  2. 简单的cpu设计 实现简单功能 使用vhdl语言做的-vhdl cpu design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1553236
    • 提供者:李志
  1. 8-bitCPUinvhdl

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  2. 8-bit cpu implemented using VHDL
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-14
    • 文件大小:3865
    • 提供者:pravin
  1. 16-bit_cpu_design

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  2. 详细介绍了如何设计一个简单的16位cpu.其中包含了从最基础的指令系统开始到最复杂的cu控制器的设计思路,方案.最后还介绍了一些有关vhdl语言的用法,并给出了具体的cpu部件的vhdl代码,从而帮助大家更为深刻的学习如何设计一个简单的cpu-Described in detail how to design a simple 16-bit cpu. Which contains the most basic instruction from the beginning to the most
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-05-06
    • 文件大小:1051306
    • 提供者:罗高
  1. CPUdesign

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  2. 计算机组成原理实验多时钟周期CPU设计,包含VHDL代码的设计,实验电路图,实验详细截图。-Computer component experiments designed more CPU clock cycles, including VHDL code design, test circuit, test detailed screenshots.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:12421741
    • 提供者:longfu
  1. FPGA-cpu

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  2. 基于FPGA的简易处理器设计2010/05/04-A simple FPGA-based processor design 2010/05/04
  3. 所属分类:Project Design

    • 发布日期:2017-04-03
    • 文件大小:98219
    • 提供者:阿锦
  1. cpu

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  2. 设计以及基本的CPU,至少包括四个基本单元,控制单元,内部寄存器,ALU和指令集-The purpose of this project is to design a simple CPU (Central Processing Unit). This CPU has basic instruction set, and we will utilize its instruction set to generate a very simple program to verify its perf
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2196060
    • 提供者:mollyma
  1. mips

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  2. MIPs CPU,VERILOG代码,经过QUARTUS综合,时序分析,验证无误。-MIPS CPU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:5137
    • 提供者:王龙
  1. CPU-to-VHDL

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  2. CPU realization using VHDL CPU realization using VHDL-CPU realization using VHDLCPU realization using VHDLCPU realization using VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2609745
    • 提供者:fantast_wong
  1. CPU

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  2. Cpu with 8 bits in VHDL verilog Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1900
    • 提供者:guilherme
  1. cpu

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  2. 包括1) 时钟发生器 2) 指令寄存器 3) 累加器 4) RISC CPU算术逻辑运算单元 5) 数据控制器 6) 状态控制器 7) 程序计数器 8) 地址多路器 -1) clock generator 2) instruction register 3) accumulator 4) RISC CPU arithmetic logical unit 5) of the data controller 6) state controller 7),
  3. 所属分类:Other systems

    • 发布日期:2017-03-28
    • 文件大小:440449
    • 提供者:liuying
  1. CPU

    0下载:
  2. VHDL16位cpu,能实现加减法移动等指令-vhdl 16 cpu,include add,sub,move and so on.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:19116
    • 提供者:王军
  1. sdsdsd

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  2. Cpu 8bit. Vorks good. Taking all instructions, sdo OR Xor and athor... Is registers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:7869
    • 提供者:kaktusasturbo
  1. cpu

    0下载:
  2. 一个简单的CPU设计,支持add,sub,mvi,mv四条指令,用Verilog语言编写,在Quratus II上编译通过,仿真正确。-A simple CPU design, support add, sub, mvi, mv four instructions, with the Verilog language, compiled by the Quratus II, the simulation is correct.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:931581
    • 提供者:姜涛
  1. VHDL-cpu

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  2. 使用vhdl 开发语言编写的 微处理器 内容比较详尽 -Developed using the language of the microprocessor vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:148844
    • 提供者:王俊
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