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搜索资源列表

  1. Exp5_UART

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  2. 用VHDL在SOPC试验箱中实现异步串行通讯转换,用VHDL硬件描述语言实现处理器CPU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:12728320
    • 提供者:jiajinying
  1. Exp3_Timer

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  2. 用VHDL在SOPC试验箱中实现定时器,用VHDL硬件描述语言实现处理器CPU-Use VHDL to implement the timer in SOPC chamber, with the VHDL hardware descr iption language processor CPU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:13106362
    • 提供者:jiajinying
  1. cpu16

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  2. 16位cpu设计vhdl源码。主要实现risc机器模型-16-bit cpu design code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:181977
    • 提供者:peterloo
  1. alu

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  2. 加法器源码 CPU设计专用 VHDL实现-Source adder VHDL CPU designed to achieve specific
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:744
    • 提供者:yuxiang
  1. CPUInterfaceDesignWithVHDL

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  2. 采用VHDL设计的CPU接口电路,源代码-CPU interface circuit, Designed using VHDL。 the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:8055
    • 提供者:
  1. msl16_vhdl

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  2. It is CPU procesor in vhdl code. made in lithuania by students of europa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:67471
    • 提供者:Virusas
  1. alu

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  2. 用VHDL语言编写的CPU当中的ALU模块,可是实现十条指令-CPU using VHDL languages among the ALU module, but to achieve ten instructions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:691
    • 提供者:wu
  1. c16_latest.tar

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  2. c16 ucore. this a 16 VHDL cpu core. complete with Assembler and C compiler. All src code included.-c16 ucore. this a 16 VHDL cpu core. complete with Assembler and C compiler. All src code included.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1711576
    • 提供者:vtaranti
  1. 61EDA_C2173

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  2. VHDL实例-完整微处理器CPU系统模型,程序均经过验证和调试,无问题-VHDL and cpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2514
    • 提供者:liumeng
  1. mips_cpu_final

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  2. 一个8位的mips cpu,采用VHDL语言编程。-this is a 8 bits mips cpu core which is writed by vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3713844
    • 提供者:chen
  1. POC

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  2. 基于VHDL开发POC接口代码,主要用于cpu和打印机之间的数据处理控制-VHDL code development based POC interfaces, cpu and the printer is mainly used for data processing control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:4784
    • 提供者:陈魁东
  1. POC1

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  2. 基于VHDL的并口控制器,用于实现CPU与打印机之间的通信。-A parallel output controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:400611
    • 提供者:liyang
  1. chap2

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  2. VHDL的CPU仿真与实现 很好的源代码介绍-The CPU simulation and VHDL source code to achieve a good descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1371489
    • 提供者:闻阿长
  1. MCU_PORT

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  2. VHDL编写的用于和CPU接口的程序,简单明了,一用就知道-Written in VHDL and the CPU interface for the program, simple and clear, one with the know
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:913
    • 提供者:宋珂
  1. scpu

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  2. 一些零散而简单的CPU功能部件,一部分源码是放在TXT文件中,只要改成VHDL格式就可以使用。-Some scattered and simple CPU features, part of the source is placed in TXT file into VHDL format as long as you can use.
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-08
    • 文件大小:155537
    • 提供者:neo
  1. jop

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  2. JOP cpu 较为完整的代码,缺少jtab。vhdl 文件,-JOP cpu more complete code, the lack of jtab. vhdl files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:12848383
    • 提供者:kappen
  1. cpu00

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  2. VHDL cpu MUTIPYL ADD SUB JMP SHIFTL -VHDL cpu MUTIPYL ADD SUB JMP SHIFTL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1300651
    • 提供者:范志明
  1. mycpu

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  2. VHDL cpu MUTIPYL ADD SUB JMP SHIFTL -VHDL cpu MUTIPYL ADD SUB JMP SHIFTL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1784555
    • 提供者:范志明
  1. vhdl_16CPU

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  2. 16位CPU设计,采用VHDL语言,自带测试汇编语言,能实现基本运算和移位、跳转等操作-16-bit CPU design, using VHDL language, self-test assembly language, to achieve the basic operations and shift operations such as jump
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:985234
    • 提供者:戈多
  1. fpga

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  2. vhdl编写的,用来模拟简单cpu的论文-vhdl cpu fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:205444
    • 提供者:耿亚涛
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