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- 采用自然采样法写的spwm,此处用VHDL编写，区别以往的方法-Written by natural sampling spwm, here written with VHDL, the difference method of the past
adc0804
- VHDL语言描述，用于实现ADC0804直流采样和显示-VHDL language descr iption, for the realization of the sampling and display the DC ADC0804
CPLD
- 基于CPLD的高速AD采样的VHDL程序-Based on CPLD high-speed AD sampling VHDL program
digital-storage-oscilloscope
- 本题设计一个数字存储示波器，以Xilinx公司20万门FPGA芯片为核心，辅以必要的外围电路（包括信号调理、采样保持、内部触发、A/D转换、D/A转换和I/O模块），利用VHDL语言编程，实现了任意波形-The problem to design a digital storage oscilloscope, to Xilinx, Inc. 200,000 FPGA chip as the core, supplemented by the necessary peripherals (incl
AD
- 一个使用VHDL语言实现AD采样控制及其数据的存储实现，让大家借鉴借鉴学习，也希望大家提出意见-Inside is a sampling AD using the VHDL language and its data storage to achieve control, so that we learn learn
Ultra-9-17
- 超声波流量计采样控制部分的VHDL源代码，基于xilinx的spartan3-The ultrasonic flowmeter sampling control part of the VHDL source code, based on xilinx s spartan3
Temperature_acquisition
- 用VHDL语言在FPGA上实现了8路温度数据的采样功能。控制THS1408芯片进行AD转换，采样后存入对应的8组寄存器，并产生使能信号通知其他模块进行8路数据的统一采样。-8-channel temperature data sampling function is implemented on FPGA using VHDL language. Control THS1408 chip AD converter, and sampled into the corresponding set o
AD
- 在Quartus环境下，VHDL语言的一个AD转换程序，即128k采样速率的模数转换-Quartus environment, the VHDL language, one of the AD conversion, 128k sampling rate analog to digital conversion
fsk_tz
- vhdl实现FSK调制，本次毕业设计的数据速率 1.2kb/s，要求产生一个1.2kHz的正弦信号，对正弦信号每周期取100个采样点，因此要求产生3个时钟信号：1.2kHz（数据速率）、120kHz（产生1.2kHz正弦信号的输入时钟）、240kHz（产生2.4kHz正弦信号的输入时钟）。基准时钟已由一个外部时钟120MHz提供，要得到前面三种时钟，就需要首先设计一个模50的分频器产生240kHz信号，再设计一个二分频器，生产一个120kHz的信号，然后再前面的基础上再设计一个模100的分频器，
hh
- 此文件是一个Butterworth IIR滤波器的VHDL程序，此滤波器是10阶的，通带频率在2.5MHz——7.5MHz，采样频率为200MHz。此滤波性能不是很好，仅供参考。-This file is the VHDL program in a Butterworth IIR filter, this filter is 10 bands, the frequency of the passband of 2.5MHz- 7.5MHz sampling frequency is 200MHz
FEP1C3_12_7_SP
- 基于FPGA的信号采集及频谱分析，用VHDL编写，压缩包里是Quartus下的工程。AD采样用状态机实现现，并存入LPM_RAM。设计了一个UART模块（也是状态机实现的），可将数据发到ＰＣ机上。 已通过测试。 -FPGA-based signal acquisition and spectrum analysis, using VHDL prepared compression bag Quartus engineering. AD sampling using the state mac
FDK
- LCD1602控制VHDL代码，带有ADC和DAC采样，以及原理图和PCB版图供参考-LCD1602 control VHDL code, with ADC and DAC sampling, as well as schematic and PCB layout for reference
library-ieee-2
- vhdl语言环境编程控制adc0809芯片进行采样控制的源文件，其中包含少许说明-vhdl adc0809
AD7793
- 运用VHDL语言，实现AD7793芯片的采样程序和SPI的通讯程序，可以将该子模块加载到主程序中。-VHDL language to achieve the AD7793 chip sampling procedures and SPI communication program, this sub-module is loaded into the main program.
AD976_6channel
- 软件是适用于FPGA的VHDL程序，目的是用于满足IEC61850－9协议的电子式互感器采样，软件采用的是AD976芯片，能同时进行6个通道的采样。-The software is based on vhdl for FPGA,which is used for electronic transformer fulfil IEC6185-9 protocol.the AD chip is AD976,it works at the state of 6 channels at the same
lcd12864
- 能用液晶12864显示A/D采样电压的关于VHDL语言编写的程序-12864 LCD can display A/D sampling the voltage on the VHDL language program
sbq
- 基于fpga和传统示波器工作方式的vhdl程序，通过ad0809采样信号（可兼容tlc5510）再经由8位da转换输出，同时输出外触发锯齿波，建议使用感性小的示波器探头，否则锯齿波低频时会出现失真-Fpga-based and traditional ways of working oscilloscope vhdl procedures, through ad0809 sampling signal (compatible tlc5510) and then through eight da
CPLD
- 基于CPLD的高速AD采样的VHDL程序-Based on CPLD high-speed AD sampling VHDL program
CPLD
- 基于CPLD的高速AD采样的VHDL程序-Based on CPLD high-speed AD sampling VHDL program
a
- 简易电子琴演奏器的VHDL实现 本实验实现了简易的电子琴演奏，包括自动和手动演奏。 输入为BTN0~BTN6，代表1~7共7个音符。音高可切换低中高音，用两个拨码开关控制：“00”为低音，“10”或“01”为中音，“11”为高音。一个拨码开关切换收动/自动。一个开关控制存储（播放存储）/不存储。一个按键clr复位。 输出为8*8点阵、两个数码管（显示音高和字符）、蜂鸣器。 具体功能： 当切换至手动模式时，根据手动按键播放音乐并显示。此时若存储开关置1，当前播放音符被存储，采样