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搜索资源列表

  1. uart

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  2. VHDL编写的异步通信串行口设计用Quartus工具编译
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:213116
    • 提供者:朱兆斌
  1. __FPGA_Prototyping_by_VHDL_Examples

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  2. 在赛灵斯上用VHDL实现,串口,PS MOUSE, PS KEYBOARD..... 协议-on Xilinx,to achieve using VHDL too fullfill UART, PS MOUSE, PS KEYBOARD ..... prototype
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:16910396
    • 提供者:jack
  1. innovateasia2009

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  2. 串口uart的vhdl,verilog,lattic实现原码-The uart serial vhdl, verilog, lattic realization of the original code
  3. 所属分类:Other systems

    • 发布日期:2017-05-26
    • 文件大小:9068524
    • 提供者:Wu
  1. UARTE

    0下载:
  2. 用VHDL语言编写的串口通讯模块,可以实现发送和接受功能。-A UART module writen in VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:486409
    • 提供者:安宁
  1. example

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  2. 我FPGA开发板的程序!!!包括数、码管iic、VGA、乘法器、串口。加法器、比较器、状态机等等等了,主要是VHDL的也有部分好似Verilog的。参考下吧-verilog...vga..uart...add...etc..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6266775
    • 提供者:地主
  1. uart_vhdl_verilog

    1下载:
  2. 串口FPGA的实现源码,VHDL和Verlog两种语言源代码。-UART FPGA implementation source code, VHDL and Verlog two languages source code .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:294012
    • 提供者:Field
  1. rs232

    0下载:
  2. VHDL 语言如何写串口的源代码,很详细的-VHDL for uart
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:2479
    • 提供者:123456
  1. baud

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  2. UART 异步通信串口协议的VHDL实现包括3个基本模块:时钟分频、接收模块和发送模块-UART asynchronous serial interface protocol VHDL consists of three basic modules: clock divider, the receiver module and transmit module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1910169
    • 提供者:songjie
  1. my_uart

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  2. 使用VHDL描述的简单的串口通讯,在Quartus上验证过,包含所有文件-this is a simple uart
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:446703
    • 提供者:路政西
  1. Recv

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  2. 运用VHDL语言,实现串口的接收子程序,可以将该子模块加载到主程序中。-VHDL UART RECEIVE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:1339
    • 提供者:陈诚
  1. xmtr

    0下载:
  2. 运用VHDL语言,实现串口的发送子程序,可以将该模块直接套入主程序。-VHDL UART SEND
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:1060
    • 提供者:陈诚
  1. UART_VHDLCodes

    0下载:
  2. 基于VHDL的异步串口收发器,在FPGA上设计Uart接收模块实现从pc接收串口数据; 在FPGA上设计Uart发送模块,把从pc接收的数据的16进制值加1再发送给PC; 设计单片机和FPGA接口模块,把接收到的数据送给单片机,并显示在LCD上 -VHDL-based asynchronous serial transceivers Uart receive module in the FPGA design from pc to receive serial data desig
  3. 所属分类:Com Port

    • 发布日期:2017-11-14
    • 文件大小:427172
    • 提供者:katheqiu
  1. UART

    1下载:
  2. 使用标准VHDL编写的RS232协议,可在CPLD或者FPGA上直接实现串口通信功能。-use VHDL to implement RS232 protocol, which can be used in CPLD or FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:530247
    • 提供者:林铎
  1. uart

    1下载:
  2. 串口通信时初学FPGA者必须要掌握的基础知识,这里给出了UART通信的VHDL代码,以及仿真测试文件。-A serial port communication beginner to must master the basic knowledge of FPGA, UART communication VHDL code is given here, and the simulation test files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1206221
    • 提供者:lirui
  1. uart

    0下载:
  2. 串口功能的硬件调试,串口功能,VHDL语言-A serial port function hardware debugging, serial port function, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:891
    • 提供者:lzx
  1. vhdl_source

    0下载:
  2. VHDL语言实现UART 串口功能;波特率可以自由设置。-VHDL language UART serial port function,The baud rate can be freely set.
  3. 所属分类:Other systems

    • 发布日期:2017-04-14
    • 文件大小:2820
    • 提供者:ybzhang
  1. uart

    0下载:
  2. VHDL语言模拟异步串口程序,实测可用,欢迎下载-uart source design by FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1757
    • 提供者:yantl
  1. UART_16750_vhdl

    0下载:
  2. UART串口FPGA源文件,VHDL设计文件,兼容16750-UART FPGA VHDL 16750
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:23295
    • 提供者:yp
  1. uart

    0下载:
  2. VHDL串口程序 波特率115200 功能:返回所发一字节数据的各位取反-UART BAUD 115200
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-13
    • 文件大小:12691687
    • 提供者:LFR&51815
  1. uart_test

    0下载:
  2. 通过FPGA,实现串口传输数据,并且可以支持多种不同的波特率,用EP4CE22F17芯片实现。(Through the FPGA, serial transmission data, and can support a variety of baud rates, using EP4CE22F17 chip implementation.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-06
    • 文件大小:2048
    • 提供者:y1a2n3g4
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