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搜索资源列表

  1. Desktop

    0下载:
  2. adder verilog. is not c language. just an adder in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1939844
    • 提供者:zotillo
  1. Four-adder-and-four--counter

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  2. 4位全加器和计数器的verilog的例程,还有四位全加器的仿真程序。-Four QuanJia device and counter verilog of the routines, and four QuanJia device simulation program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:2902
    • 提供者:明晓昕
  1. Fast-adder-design-using-verilog

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  2. 用Verilog设计各种快速加法器(四位先行进位加法器、选择进位加法器、流水线加法器)-Verilog design all kinds of fast adder (four first adder, select adder pipelined adder)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:941498
    • 提供者:zhxuqin
  1. CarryLookaheadAdder64

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  2. 一个64位超前进位加法器,verilog语言描述。-A 64 bits carry look ahead adder, verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:989
    • 提供者:张松
  1. acc

    0下载:
  2. 全加器,比较器等verilog hdl代码 以及测试代码-Full adder verilog hdl code of the comparator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1483
    • 提供者:徐鹏伟
  1. Verilog-examples

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  2. verilog 例程,白金手册,很多实用例程,加法器,循环编码器-verilog routines, platinum manual, many utility routines, adder, cycle coding and more
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:113245
    • 提供者:艾米丽
  1. adder

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  2. This the program for addition in verilog-This is the program for addition in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:307764
    • 提供者:chella
  1. adder

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  2. 可加可减器,使用verilog编写,4位加减器。-Can be increased or decreased, verilog prepared 4 addition and subtraction.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1300492
    • 提供者:王赢之
  1. adder

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  2. adder in verilog only with combinational logic use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1711350
    • 提供者:ykcir
  1. full_a4

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  2. 4位全加器的verilog程序设计-Four full adder verilog programming ...
  3. 所属分类:Other systems

    • 发布日期:2017-05-17
    • 文件大小:4257675
    • 提供者:忘忧草
  1. ripple_carry_adder

    0下载:
  2. 行波加法器,Verilog语言编写。行波加法器,Verilog语言编写-The line wave adder Verilog language. The line wave adder Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:619
    • 提供者:周杰伦
  1. add

    0下载:
  2. 用verilog实现加法器程序,通过仿真验证-Adder verilog achieve program is verified by simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:215944
    • 提供者:蚩建峰
  1. float

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  2. 32位浮点加法器 verilog语言编写-32-bit floating-point adder verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:1226
    • 提供者:
  1. add

    0下载:
  2. 加法器的verilog代码希望对需要的人起一定的参考-Adder verilog code hope for those who need to play a certain reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:7163
    • 提供者:david
  1. code

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  2. 32bits流水线加法器,verilog语言的,xilinx公司芯片上运行通过-The 32bits pipelined adder verilog language, xilinx chip run through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:933
    • 提供者:许阳
  1. daima

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  2. 32bits进位选择加法器,verilog语言的,xilinx公司芯片上运行通过-The 32bits carry select adder verilog language, xilinx chip run through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:1387
    • 提供者:许阳
  1. daima

    0下载:
  2. 32bits提前进位加法器,verilog语言的,xilinx公司芯片上运行通过-The 32bits advance carry adder verilog language, xilinx chip run through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:43708
    • 提供者:许阳
  1. code

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  2. 32bits补码加法器,verilog语言的,xilinx公司芯片上运行通过-The 32bits complement adder verilog language, xilinx chip run through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:984
    • 提供者:许阳
  1. 4bit-parallel-adder

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  2. The program contains verilog code for 4bit parallel adder
  3. 所属分类:MiddleWare

    • 发布日期:2017-11-26
    • 文件大小:2403
    • 提供者:dorababugfree
  1. Carry_Select_Adder_Verilog

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  2. 进位选择加法器,verilog实现。包含3个TB。-Carry Select Adder. Verilog fulfilled. Three testbenches included.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:2789
    • 提供者:张昊溢
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