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  2. 基于FPGA的简单计算器系统的设计,使用了vhdl与verilog语言,附有文档介绍-Simple calculator system based on FPGA design using vhdl verilog language, with document describes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:5671150
    • 提供者:于智同
  1. calculater_xu

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  2. 基于fpga的简易计算器,可以实现三位数乘以三位数的运算-Fpga-based simple calculator, can achieve three-digit multiplied by the three-digit arithmetic
  3. 所属分类:Other systems

    • 发布日期:2017-11-20
    • 文件大小:12464537
    • 提供者:徐俊龙
  1. FPGADE270CACULATOR

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  2. 本文介绍了一个简单的计算器的设计,该设计采用了现场可编程逻辑器件FPGA设计,并基于VHDL语言实现加减乘除功能,并用十进制显示在LCD1602上。-This article describes a simple calculator design that uses a field programmable logic device FPGA design and VHDL language based on arithmetic functions, and decimal display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-01
    • 文件大小:3398656
    • 提供者:南宫崔浩
  1. syn_cnter_4_ok

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  2. FPGA的应用实例,简要介绍了该计算器设计的流程以及编码过程。-FPGA application examples, and a brief introduction to the process and the coding process calculator design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-25
    • 文件大小:162816
    • 提供者:流星雨
  1. SBcalculator

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  2. fpga简易二进制输入十进制输出计算器,八位拨码开关输入,四位数码管输出。开发板:Spartan 3E XC3S100E CP132 -5-A simple binary-decimal calculator. Spartan 3E XC3S100E CP132 -5
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2286
    • 提供者:马睿
  1. DDS

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  2. 基于fpga的DDS详细设计方案 verilog语言 正弦计算器则对该相位值计算数字化正弦波幅度(芯片一般通过查表得到)。DDS芯片输出的一般是数字化的正弦波,因此还需经过高速D/A转换器和低通滤波器才能得到一个可用的模拟频率信号。-Direct Digital Synthesizer base on fpga use verilog Sine calculator to calculate the value of the digital phase sine wave amplitu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5949576
    • 提供者:网窝囊
  1. jsq

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  2. 基于FPGA的计算器,可以实现加减乘除运算功能,由于时间问题,浮点运算未能实现,其中的二进制与BCD码相互转换的模块可以使用-FPGA-based calculator, arithmetic calculation function can be achieved, due to time issues, floating-point operations failed to achieve, including binary and BCD code conversion modules t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1220427
    • 提供者:
  1. jisuan

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  2. 4*4键盘输入实现加减乘的计算器,数电实验大作业,下到FPGA实验正确。-4* 4 keyboard input to achieve modified by the calculator, the large number of electrical test operations, right down to the FPGA experiment.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:649058
    • 提供者:李依
  1. AnJian_1602

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  2. 计算器设计。采用了现场可编程逻辑器件FPGA设计,并基于VHDL语言实现加减乘除功能,并用十进制显示在数码管上。计算部分为加法器、减法器、乘法器和除法器组成。使用Altera公司的QuartusII开发软件进行功能仿真并给出仿真波形,并下载到试验箱,用实验箱上的按键开关模拟输入,用数码管显示十进制计算结果。通过外部按键可以完成四位二进制数的加、减、乘、除四种运算功能,其结果简单,易于实现。-Calculator design. Using a field programmable logic d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-31
    • 文件大小:13138994
    • 提供者:陈勒
  1. counter_seg_code

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  2. 对于学习FPGA的同学来说计算器分频是必不可少的流程 但是通常将两者配合起来使用是很重要的-It is essential for students to learn FPGA to divide the calculator, but it is important to use them together.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3271
    • 提供者:Gent Liu
  1. EDA1_MusicCalculator

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  2. 音乐计算器,可实现999以下加减法及与非运算功能,并能够播放两段音乐,可下载到FPGA板子上实现。-Music Calculator
  3. 所属分类:Other systems

    • 发布日期:2017-03-28
    • 文件大小:28337
    • 提供者:戚若玫
  1. 2014011494

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  2. FPGA嵌入式开发全加法器程序。二进制运算器及数码管扫描电路-FPGA embedded development full adder program. Binary calculator and digital tube scanning circuit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-11
    • 文件大小:1606576
    • 提供者:李思宇
  1. fdfd

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  2. 第二章 设计思路 2.1 设计总体框图 有分析可知,本次课程设计可以分成五个木块来实现相应的功能,分别是输入模块,计算模块,扫描模块,输出模块以及显示模块。((Calculator design based on FPGA DE2 development board. language use Verilog. Matrix keyboard input, LCD1602 display. Program includes key scanning module and LCD modul
  3. 所属分类:数据库编程

    • 发布日期:2018-01-08
    • 文件大小:1024
    • 提供者:fsfsfsfs
  1. calculate_src

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  2. 基于FPGA,实现计算器功能。可运行,能进行基础的加减乘除功能。(FPGA, calculator, use c language)
  3. 所属分类:单片机开发

    • 发布日期:2018-04-20
    • 文件大小:11264
    • 提供者:l619999872
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