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用FPGA实现使用LDPC编码器和译码器-FPGA implementation by using LDPC encoder and decoder
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低密度奇偶校验码(简称LDPC码)是目前距离香农限最近的一种线性纠错码,它的直接编码运算量较大,通常具有码长的二次方复杂度.为此,利用有效的校验矩阵,来降低编码的复杂度,同时研究利用大规模集成电路实现LDPC码的编码.在ISE 8.2软件平台上采用基于FPGA的Verilog HDL语言实现了有效的编码过程,为LDPC码的硬件实现和实际应用提供了依据-Abstract:Low.density parity·check code(LDPC code)is a kind of linear eror
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数字电视传输系统中LDPC码编码器的研究与FPGA实现,详细介绍了编译码原理以及具体的实现过程-Digital TV transmission systems of LDPC encoder and FPGA implementation, detailing the encoding and decoding as well as specific realization of the principle
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LDPC码的FPGA实现,大家相互学习下-the code of LDPC implementation by FPGA
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本文首先回顾了LDPC码的发展历程和现状,介绍了LDPC码检验矩阵的构造、编
译码原理。在对编译码作了深入探讨和分析后,接着进行了RU算法编码和长码编码
的FPGA实现;根据二叉树的性质,提出了一种长码编码的ASIC优化设计的方法,节省
了大量硬件资源;论文详细阐述了CORDIC算法原理以及LDPC码译码中所采用的指
数函数和反双曲正切函数的FPGA实现:CORDIC内核及前后处理单元设计、仿真、综
合及数据分析,这对LDPC码的译码具有很重要的意义,为用数字VLSI来实现LDPC的
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