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  1. 洗衣机

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  2. 通过不同的二极管亮,表示洗衣机的不同状态。如正转、反转、洗条、干衣。按下P3_3时,会停止。 -through different diode light, washing machines, said the different states. Who is changed, and turned around, washing, drying. Press P3_3, would cease.
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:24225
    • 提供者:SKY
  1. Font_view

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  2. 转贴原作者声明: ViewChr 程序使用说明: 本程序可方便浏览和调用 Hzk16(16*16中文点阵字库)和Asc16(8*16中文点阵字库)内容。 通过滚动条对字库进行浏览,通过文本框可以输入中文字符获取其字体点阵,按\"Add chr.asm\"键或回车键可以将其字体点阵16进制数据转换成对应的ASCI码追加到CHR.ASM文件中。在显示文字区域双击可切换网格显示开关状态。 如果你要做点阵屏显示中文字体程序,那这个程序将是你的好帮手。 (
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:146108
    • 提供者:申平
  1. vgactrl

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  2. vga控制电路原码。主要有时序产生模块,彩条产生模块和接口模块。改程序主要用状态机来实现,两个计数器来控制状态的翻转。-vga control circuit original code. Sequencers have a major modules of exotic produce modules and interface modules. Procedures in the main state machine to achieve, two counter to the state
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1117
    • 提供者:lili
  1. 107215824washingmachine

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  2. 通过不同的二极管亮,表示洗衣机的不同状态。如正转、反转、洗条、干衣。按下P3_3时,会停止
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:1129
    • 提供者:李杰
  1. VHDL-XILINX-EXAMPLE26

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  2. [VHDL经典设计26例]--在xilinx芯片上调试通过--[01--1位全加器][02--2选1多路选择器][03--8位硬件加法器][04--7段数码显示译码器][05--8位串入并出寄存器][6--8位并入串出寄存器][7--内部三态总线][8--含清零和同步时钟使能的4位加法计数器][9--数控分频器][10--4位十进制频率计][11--译码扫描显示电路][12--用状态机实现序列检测器的设计][13--用状态机对ADC0832电路控制实现SIN函数发生器][14--用状态机实现AD
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:3688067
    • 提供者:fuhao
  1. Micro-program

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  2. 微程序控制电路是CPU 控制器的核心电路,控制产生指令执行时各部件协调工作所需的所有控制信号,以及下一条指令的地址。微程序控制器的组成如图6-12 所示,主要由三个部分组成,分别是微指令控制电路、微地址寄存器和微指令存储器lpm_rom 其中微指令控制电路用组合电路对指令中的1[7..2] 、操作台控制信号SWA 和SWB 的状态、状态寄存器的输出状态FC 、FZ ,产生微地址变化的控制信号,实现对微地址控制:微地址寄存器控制电路的基本输入信号是微指令存储器的下地址字段M[6..1] ,同时还受
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-09
    • 文件大小:2584740
    • 提供者:623902748
  1. RISC-CPU

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  2. 用FPGA实现一个简易的CPU,采用精简指令集结构,每一条指令有16bit,高三位为指令操作数,后13位为地址,该CPU能实现8种指令操作,分别有HLT(空一个中期)ADD(相加操作)SKZ(为零跳过)AND(相与操作)XOR(异或操作)LDA(读数据)STO(写数据)JMP(无条件跳转指令)。cpu包括8个部件,分别为时钟发生器、指令寄存器、累加器、算术逻辑单元、数据控制器、状态控制器、程序计数器、地址多路器,各个部件之间的相互操作关系由状态控制器来控制,程序指令存放在初始rom中,本例程存放
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3147284
    • 提供者:vice
  1. Keyboard

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  2. 用EVC++ 4.0编写的wince 软键盘源代码, EVC C-Prepared using EVC++ 4.0 source code in wince soft keyboard, EVC C++
  3. 所属分类:Windows CE

    • 发布日期:2017-04-09
    • 文件大小:1350237
    • 提供者:顾建林
  1. dual_port_RAM

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  2. 可靠性的设计应用硬件连线保证握手。 以MCU+IDT7132+PC结构为例子: IDT7132两侧的BUSY线分别接到MCU的INT0中断上和PC总线的A10脚(IO-CH-RDY)上,作为MCU和计算机同时读写IDT7132 的同一个地址单元时的“忙闲”状态线。当两侧访问不同的地址单元时,BUSY线无效,两侧操作互不影响。当两侧“几乎同时”访问同一个单元时,按IDT7132的总线仲裁逻辑,对两侧的片选信号和地址信号之一到达时间间隔只要大于5ns,就能对先到达的一侧提供
  3. 所属分类:SCM

    • 发布日期:2017-04-01
    • 文件大小:97457
    • 提供者:wang
  1. ylvga

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  2. 实现vga显示控制器的基本显示,其中有基本横竖彩条显示模式,彩色方格模式,小鱼自主控制移动模式,且背景颜色可由用户输入更换。显示良好,状态转移可控。-Vga display controller to achieve the basic display, including basic color of the horizontal and vertical display mode, color grid pattern, self-control fish movement patterns
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1142024
    • 提供者:yanglun
  1. traffic

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  2. 一条主干道,一条乡间公路。组成十字路口,要求优先保证主干道通行。有MR(主红)、MY(主黄)、MG(主绿)、CR(乡红)、CY(乡黄)、CG(乡绿)六盏交通灯需要控制;交通灯由绿→红有4秒黄灯亮的间隔时间,由红→绿没有间隔时间;系统有MRCY、MRCG、MYCR、MGCR四个状态-A main road, a country road. Composition of the crossroads, requiring priority to ensuring the main road traf
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:218128
    • 提供者:guo
  1. trafficlight

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  2. 一个十字路口交通控制系统,其东西,南北两个方向除了有红、黄、绿灯指示是否允许通行外,还设有时钟,以倒计时方式显示每一路允许通行的时间,绿灯,黄灯,红灯的持续时间分别是40、5和45秒。当东西或南北两路中任一道上出现特殊情况,例如有消防车,警车要去执行任务,此时交通控制系统应可由交警手动控制立即进入特殊运行状态,即两条道上的所有车辆皆停止通行,红灯全亮,时钟停止计时,且其数字在闪烁。当特殊运行状态结束后,管理系统恢复原来的状态,继续正常运行- An intersection traffic c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:387801
    • 提供者:patient sun
  1. traffic-lights-the-controller-design

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  2. 设计一个十字路口的交通灯控制器,能显示十字路口东西、南北两个方向的红、黄、绿灯的指示状态。两组红、黄、绿三种颜色的灯分别作为东西、南北两个方向的红、黄、绿灯。变化规律为:东西绿灯亮,南北红灯亮,东西黄灯亮,南北红灯亮,东西红灯亮,南北绿灯亮,东西红灯亮,南北黄灯亮,东西绿灯亮,南北红灯亮……,这样循环下去。 南北方向是主干道车到,东西方向是支干道车道,要求两条交叉道路上的车辆交替运行,主干道每次通行时间为30秒,支干道每次通行时间为20秒,时间可设置修改。 在绿灯转为红灯时,要求黄灯先亮
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:169279
    • 提供者:sunny
  1. shiyanwu

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  2. 用VHDL编程实现一条主干道,一条乡间公路。组成十字路口,要求优先保证主干道通行。有MR(主红)、MY(主黄)、MG(主绿)、CR(乡红)、CY(乡黄)、CG(乡绿)六盏交通灯需要控制;交通灯由绿→红有4秒黄灯亮的间隔时间,由红→绿没有间隔时间;系统有MRCY、MRCG、MYCR、MGCR四个状态;-VHDL programming to a main road, a country road. Composed of a crossroads, requiring priority to en
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:136042
    • 提供者:高华
  1. IIC

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  2. Inter-Integrated Circuit总线是由PHILIPS公司开发的两线式串行总线,用于连接微控制器及其外围设备 。它是同步通信的一种特殊形式,具有接口线少,控制方式简单,通信速率较高的特点。只需要一条串行数据线SDA,一条串行时钟线SCL 。它是一个真正的多主机总线,如果两个或更多主机同时初始化,数据传输可以通过冲突检测和仲裁防止数据被破坏;串行的8 位双向数据传输位速率在标准模式下可达100kbit/s,快速模式下可达400kbit/s,高速模式下可达3.4Mbit/s;连接到相
  3. 所属分类:SCM

    • 发布日期:2017-03-23
    • 文件大小:2602
    • 提供者:mary
  1. trafficlight

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  2. 该数字系统完成对十字路口交通信号灯的控制,十字路口由一条东西方向的主干道(简称A道)和南北方向的支干道(简称B道)构成。 十字路口交通灯控制规则为: (1) 初始状态为4 个方向的红灯全亮,时间1s。 (2) 东西方向绿灯亮,南北方向红灯亮。东西方向通车,时间30s。 (3) 东西方向黄灯亮,南北方向红灯亮,时间5s。 (4) 东西方向红灯亮,南北方向绿灯亮。南北方向通车,时间20s。 (5) 东西方向红灯亮,南,北方向黄灯亮,时间5s。 (6) 返回(2),继续运行。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:699632
    • 提供者:蔡利波
  1. jiaotongdeng

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  2. 使用vhdl语言设计交通信号灯。由一条主干道和一条支干道汇合成十字路口,在每个入口处设置红、绿、黄三色信号灯,红灯亮禁止通行,绿灯亮允许通行,黄灯亮则给行驶中的车辆有时间停在禁行线外。主干道处于常允许通行的状态,支干道有车来时才允许通行,主、支干道均有车时,两者交替允许通行,主、支干道每次放行时间不得短于30S,在每次由绿灯亮到红灯亮的转换过程中,要亮4S黄灯作为过渡。 -Using vhdl language design traffic lights. By a main road a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:56900
    • 提供者:陈小龙
  1. VHDLtrafficlight

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  2. 设计一个交通灯,在正常情况下指挥一个十字路口的交通,有红黄绿三种状态,每次绿(红) 灯为三十秒;拥有紧急情况按键,此时相应的道路将一直为绿灯,另一条路则为红灯。 -Design of a traffic light, to commanding a crossroads of traffic under normal circumstances, red yellow and green three states, each green (red) lights for thirty sec
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:316252
    • 提供者:陈大伟
  1. RISC-CPU

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  2. 精简指令集 CPU 通过仿真验证正确 (使用之前务必看readme文件,和结构图!) 1. 此cpu是夏宇闻 verilog数字系统设计教程中最后一章的例程。 2. 学习时务必先搞明白框图原理,和数据流动!!! 3. 牢记主状态机中一条指令周期中传输的16bit=3bit指令+13bit地址。 4. 理解数据总线,和地址总线。区分数据和地址。 5. 仔细调试,因为书中有很多小错误。 程序经过quartusii编译通过,另外经过modelsim仿真正确。-RISC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:4338145
    • 提供者:刘栋
  1. shiyan5

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  2. 开发环境:unSP IDE 2.0.0 实验目的: 1)了解SPCE061A串行口(UART)的结构、与PC机串行通讯的原理。 2)了解UART的各配置单元P_UART_BaudScalarLow (7024H)、P_UART_BaudScalarHigh (7025H)、 P_UART_Command1(7021H)和P_UART_Command2 (7022H)的功能及控制方法。 3)掌握PC机与单片机通讯的编程方法。 实验设备: 1) 装有µ ’
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:23776
    • 提供者:niu
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