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  1. xapp514_aes3-audio

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  2. DVB数字音频接口(AESEBU)encoder源码,包括VHDL和VERILOG,基于XILINX FPGA,已验证.-AES-EBU interface,VHDL,VERILOG

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-16
    • 文件大小：4483338
    • 提供者：dcshl

  1. CONVOLUTIONAL_INTERLEAVER

    0下载：
  2. DVB数据交织,交织深度I=12,已得到应用!-DVB data interleaving, interleaving depth I = 12, has been applied!

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-02
    • 文件大小：1279
    • 提供者：sun
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