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搜索资源列表

  1. median-filter

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  2. 基于FPGA的图像中值滤波算法的优化及实现vhdl-中值滤波 利用VHDL语言实现三级流水线中值滤波-FPGA-based image filtering algorithm optimization and realization of vhdl-median filter using VHDL language three pipelined median filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:670byte
    • 提供者:站长
  1. median_filterCode

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  2. 采用快速中指滤波算法实现图像的中值滤波,使用VHDL语言ISE环境-Image Median Filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-05
    • 文件大小:11.67kb
    • 提供者:若谙
  1. Fingerprint_Identify

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  2. 本项目名称是:基于FPGA的指纹识别模块设计。 主要内容为:本模块采用xilinx公司的Spartan 3E系列XC3S500E 型FPGA作为核心控制芯片,通过富士通公司的MFS300滑动式电容指纹传感器对指纹图象进行提取,然后对提取的指纹图像进行灰度滤波、图像增强、二值化、二值去噪、细化等预处理,得到清晰的指纹图象,再从清晰的指纹图象中提取指纹特征点,存入外部FLASH作为建档模板。指纹比对时,采用同样的方法获得清晰的指纹图像,建立比对模板,然后将比对模板与建档模板利用点模式匹配
  3. 所属分类:VHDL编程

    • 发布日期:2013-08-08
    • 文件大小:186.53kb
    • 提供者:xiaoxu
  1. mid-filter

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  2. mid-filter 中值滤波算法的原理及核心代码 word版-mid-filter median filter and the core principles of the code word version
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:55.61kb
    • 提供者:王传伟
  1. shape

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  2. 滤波器设计,利用中值法完成的梯形滤波的算法,可用于谱仪的滤波器-filter verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:564byte
    • 提供者:帅秀
  1. 5354

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  2. 图像的中值滤波算法及其FPGA实现Image median filtering algorithm and its FPGA implementation-Image median filtering algorithm and its FPGA implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:938.24kb
    • 提供者:mfc
  1. all_MedFilter_VHDL

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  2. 本文介绍了中值滤波算法的FPGA详细实现,很详细,很全-This article describes the median filter algorithm to achieve the FPGA detailed, very detailed, very full
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.01kb
    • 提供者:杨遥
  1. Reconfigurablefliter

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  2. 自己编写的SystemC源代码,拥有五级流水线的可重构图像滤波器,支持两种图像滤波算法,中值滤波和邻域平均滤波,支持算法配置-I have written SystemC source code, the reconfigurable image filter has a five-stage pipeline, supports two types of image filtering algorithms, median filtering and neighborhood average
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:18.11mb
    • 提供者:SuperWang
  1. mode3by3_generate_module

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  2. 用verilog编写的3x3模块!用于图像处理算法中的中值滤波和边缘检测等等!-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:912.4kb
    • 提供者:张皓
  1. Median-implemnt-baseline-drift

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  2. 工程文件中代码是通过中值滤波算法实现基线漂移-Project file code median filtering algorithm by baseline drift
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.69mb
    • 提供者:lincy_dd
  1. FPGA-based-image-median-filtering

    0下载:
  2. 基于FPGA的图像中值滤波,在xilinx的FPGA上实现了算法,采用matlab的算法最终通过了验证。-FPGA-based image median filtering on xilinx FPGA implementation of the algorithm, using matlab algorithm finally passed validation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-19
    • 文件大小:26.42mb
    • 提供者:lushusho
  1. MID_FILTER

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  2. 中值滤波算法的verilog实现,可用于相关算法在基于FPGA的嵌入式图像处理系统中。-Median filtering algorithm verilog realization available FPGA-based embedded image processing system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.63mb
    • 提供者:shimmy_lee
  1. median5x1

    0下载:
  2. 一个自己写的5x1中值滤波算法,可以直接使用.-It is 5x1 median filter arithmetic.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:896byte
    • 提供者:梁雄
  1. VIP_RAW2RGB2Gray_Medium_Sobel_Erosion_Dilation

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  2. 通过纯HDL逻辑实现,对ov7725摄像头进行图像采集,存储,处理,包括中值滤波,边缘检测等经典图像算法实现(Through the realization of pure HDL logic, image acquisition, storage and processing of ov7725 camera, including median filtering, edge detection and other classic image algorithms.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-03
    • 文件大小:910kb
    • 提供者:SakuraForever
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