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搜索资源列表

  1. 除法器

    0下载:
  2. 通过用硬件描述语言(VHDL)描述除法器,并进行模拟验证,加深对二进制数运算方法的理解。 设计平台:MaxPlusII 压缩文件内有详细设计报告 -by using Hardware Descr iption Language (VHDL) Descr iption division, and conduct simulation shows that the binary number deepen understanding of the operation. Design Pl
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:50091
    • 提供者:johnmad
  1. EDA

    0下载:
  2. 里面是一个FIR滤波器的设计报告 里面有具体的 代码 等等 加法器 乘法器 见发起 等等 承平
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:189279
    • 提供者:丛宇
  1. zsjs20070890

    0下载:
  2. 基于VHDL8路抢答器系统设计报告,7128S芯片的,有需要的朋友可以
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:227788
    • 提供者:麦佳
  1. HardwareflowerdesignEDAdesignreport

    0下载:
  2. 硬件电子琴电路设计EDA设计报告,开发环境VHDL
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:48263
    • 提供者:百事可乐
  1. vhdl

    0下载:
  2. 课程设计 报告多信号 发生
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:120898
    • 提供者:shinan
  1. sell

    0下载:
  2. 用HDL语言编写,实现自动售货机基本功能,含设计报告和.V文件。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:239530
    • 提供者:zixue
  1. 微处理器的设计与实现

    0下载:
  2. 一个简单的微处理器的实现,能够进行几种常见的操作,对于熟悉计算机的工作原理很有帮助,并且附有详细的设计报告和设计思路。在word文档最后给出了源代码。-a simple microprocessor to achieve, for several common to the operation of the computer for those familiar with the working principle helpful, and with the detailed design re
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:448298
    • 提供者:郭慧勤
  1. 数字频率计实验报告

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  2. 课程设计要求设计并用FPGA实现一个数字频率计,具体设计要求如下: 测量频率范围: 10Hz~100KHz 精度: ΔF / F ≤ ±2 % 系统外部时钟: 1024Hz 测量波形: 方波 Vp-p = 3~5 V 硬件设备:Altera Flex10K10 五位数码管 LED发光二极管 编程语言:Verilog HDL / VHDL-curriculum design and FPGA design to achieve a digital frequency meter,
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:144900
    • 提供者:
  1. 基于FPGA的verilog语言的10种流水灯的设计报告

    2下载:
  2. 基于FPGA的verilog语言的10种流水灯的设计报告,有相应的方框图和具体的程序解释-FPGA-based verilog language of the 10 water light design report, there is a corresponding block diagram and detailed explanation of the procedures
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:89088
    • 提供者:柳沐璇
  1. VHDL_TP3067_PCM.用VHDL写的控制TP3067实现PCM编译码程序

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  2. 用VHDL写的控制TP3067实现PCM编译码程序 包括系统原理图,VHDL源程序,各部分电路仿真。及完整的课程设计报告 ,To use VHDL to write the control of TP3067 to achieve PCM encoding and decoding procedures, including system schematic, VHDL source code, the part of the circuit simulation. And complete
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:3392938
    • 提供者:胡宁博
  1. shuzi.rar

    0下载:
  2. 数字电子钟设计,整点报时,时分秒分模块设计,另附实验报告和实验结果,内容详细不容错过,The design of digital electronic clock, the whole point of time when minutes and seconds sub-module design, an additional test reports and laboratory test results, the details not to be missed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1312621
    • 提供者:洪栋
  1. synth_fft

    0下载:
  2. 甘地大学电子专业Ray Ranjan Varghese设计的FPGA实现FFT,采用的是单精度的浮点,采用IEEE745格式的浮点+ROM RAM的方式成功实现FFT,含有设计报告和设计源代码,并有测试文件,真的很不错。 -Gandhi University of Electronic Design Professional Ray Ranjan Varghese FPGA realization of FFT, using a single precision floating-point,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:418973
    • 提供者:何渊泽
  1. cpld

    0下载:
  2. 西安工业大学电信学院信息与通信系综合设计报告 -Xi an University of Technology Institute of Information and Communications Department of Telecommunications comprehensive design report
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3213293
    • 提供者:王丹
  1. VHDL

    2下载:
  2. 微波炉定时控制器的设计,已成功经过调试,并有相应的课程设计报告-Microwave oven controller design from time to time, after successfully testing and a corresponding report of the curriculum design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-03
    • 文件大小:187378
    • 提供者:林君霞
  1. MIPS_CPU

    0下载:
  2. 一个完整的MIPS CPU的设计,是创新设计项目,内含详细的项目设计报告-A complete MIPS CPU design, innovative design projects, detailed project design report containing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1870334
    • 提供者:
  1. Octave_organ_EDA_curriculum

    0下载:
  2. 八音电子琴EDA课程设计报告,包含vhdl的程序和原理图文件 -Octave organ EDA curriculum design report, including vhdl schematic diagram of the procedures and documents
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:81249
    • 提供者:香味
  1. vhdl

    0下载:
  2. 抢答器的vhdl设计 设计任务: (1)设计一个可容纳4组参赛的数字式抢答器,每组设一个按钮,供抢答使用。 (2)抢答器具有第一信号鉴别和锁存功能,使除第一抢答者外的按钮不起作用。 (3)设置一个主持人“复位”按钮。 (4)主持人复位后,开始抢答,第一信号鉴别锁存电路得到信号后,由指示灯显示抢答组的编号,同时扬声器发出2~3秒的音响。 扩展功能: (5)设置一个计分电路,每组开始预制100分,由主持人计分,答对一次加10分,答错一次减10分。 计要求: (1
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1335
    • 提供者:冷与
  1. TAXI

    1下载:
  2. 收录大量的出租车计费系统设计的资料 基于CPLD FPGA的设计抱过设计报告-Contains a large number of taxi billing information system design based on CPLD FPGA design report hug
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8976658
    • 提供者:yangvan
  1. Digital-stopwatch-design

    0下载:
  2. 数字秒表的设计报告,用VHDL语言编写程序,实现分析讨论中各种功能,分别进行编译并生成相应的模块,然后将这些模块连接起来形成电路图,并进行编译、仿真。-Digital stopwatch design reports, using VHDL language programming, analysis and discussion of various functions to achieve, respectively, to compile and generate the correspo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:375786
    • 提供者:吴亮
  1. EDA课程设计

    0下载:
  2. 这是一个NB的EDA课程设计报告,使用VHDL语言编写,一看就懂。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:328745
    • 提供者:上扬
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