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  1. test81

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  2. DE2 音频处理 从SD卡读去音乐数据在做相应的处理,通过 音频输出口播放 同事可以从音频输入口加入相应的音乐 也可以从MIK口输入音频-DE2 audio processing time from the SD card to do the music data in the processing, I play through the audio output from the audio input of my colleagues to join the music I can
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5126256
    • 提供者:lin jin
  1. S12_AudioLoopback_DAV_MIC

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  2. 从MIC输入一段音频然后,再从AOUT的接口播放出来的verilog 的代码-Input from the MIC for some audio and then AOUT interface from broadcast in the Verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2413849
    • 提供者:zl.yin
  1. de2sound

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  2. 这个设计结合音频输入从麦克风和线路信号和输出结果线输出信号。麦克风连接话筒端口、音源线在端口,扬声器/耳机线端口。-This design combines audio input from the microphone and line in signals and outputs the result to the line out signal. Connect a microphone to the MIC port, an audio source to the LINE IN por
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:105884
    • 提供者:胡伟
  1. 2010011022

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  2. 在电子领域内,频率是一种最基本的参数,并与其他许多电参量的测量方案和测量结果都有着十分密切的关系。由于频率信号抗干扰能力强、易于传输,可以获得较高的测量精度。因此,频率的测量就显得尤为重要,测频方法的研究越来越受到重视。   频率计作为测量仪器的一种,常称为电子计数器,它的基本功能是测量信号的频率和周期频率计的应用范围很广,它不仅应用于一般的简单仪器测量,而且还广泛应用于教学、科研、高精度仪器测量、工业控制等其它领域。在数字电路中,数字频率计属于时序电路,它主要由具有记忆功能的触发器构成。在
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:611328
    • 提供者:程琳
  1. DE2_SDCARD

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  2. DE2 音频处理 从SD卡读去音乐数据在做相应的处理,通过 音频输出口播放 同事可以从音频输入口加入相应的音乐 也可以从MIK口输入音频-DE2 -DE2 audio processing time from the SD card to do the music data in the processing, I play through the audio output from the audio input of my colleagues to join the music I can
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9873869
    • 提供者:chou
  1. voice

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  2. 实现DE2板上的音频输入和其频谱的VGA显示- DE2-based project about the input audio and its spectrum on VGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2251885
    • 提供者:刘毅
  1. DE2_i2sound

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  2. 在DE2开发板上实现对固定2KHZ噪音的滤波,音频输入信号为模拟信号,经过DE2开发板内的音频芯片WM8731处理得到数字信号。-implemention of a FIR filter(20KHz) on altera de2 board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3830137
    • 提供者:
  1. DE2_i2sound

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  2. 这种设计将来自麦克风的音频输入信号线相结合,并把结果输出到输出信号线。将麦克风连接到MIC端口,一个音频源的LINE IN端口,扬声器/耳机的LINE OUT端口。-This design combines audio input from the microphone and line in signals and outputs the result to the line out signal. Connect a microphone to the MIC port, an audio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:465541
    • 提供者:黯魂天残
  1. fenpinqi

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  2. 模拟分频器是音箱内的一种电路装置,用以将输入的模拟音频信号分离成高音、中音、低音等不同部分,然后分别送入相应的高、中、低音喇叭单元中重放。之所以这样做,是因为任何单一的喇叭都不可能完美的将声音的各个频段完整的重放出来。-The analog divider speakers within a circuit device to the input analog audio signal is separated into different parts of the treble, alto,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:11045
    • 提供者:冯初晨
  1. Altera_Audio

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  2. 针对Altera的DE2/ DE1交互板的音频核心的音频编解码器(编码器/解码器),并提供了音频输入和输出的接口。-The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and output.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:864355
    • 提供者:姚龙海
  1. Infrared-light-transmission-

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  2. 将音频信号输入到电路中,发射端利用红外光发射出去,接收端进行接受,经AD处理,由声音的高低控制灯的量灭,另外将温度实时采集并显示在数码管上,详情请见压缩包中的文档-Audio signal input to the circuit, transmitter with infrared emission, the receiver to accept the AD processing, controlled by the sound of the amount of light, in addi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3591219
    • 提供者:崔兴
  1. zybo_zynq_audio

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  2. Zybo xc7z010 uation board,ssm6203音频编码器,PC端给音频输入,HPH输出口输出过滤噪音的音频,软件:xilinx vivado, vivado HLS, SDK-Zybo xc7z010 uation board, ssm6203 audio encoder, PC end to the audio input, HPH output port noise filter audio software: xilinx vivado, vivado HLS, SD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:4095992
    • 提供者:Lisa
  1. NoSocAdau1761_zyz

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  2. 在Zedboard上测试Adau1761录放音 郑郁正 1. 这个项目来自网上:Zedboard_d base_project。 2. 项目不是vivado工程,而是ise工程。 3. 项目的功能是将PC机播放的声音从Zedboard的Line In声音口输入,从耳机口输出。 4. 不支持话筒输入,也就是Micphone不起作用。 5. 不支持LineOut喇叭口输出。 6. 输出音量可以通过sw0、sw1选择,组合支持四级音量。 测试上工程时,要制作
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1205924
    • 提供者:郑郁正
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