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  1. DE2_115_SD_CARD

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  2. DE2-115的SD卡读写实验,基于NIOS和C语言编写的代码-DE2-115 SD card reader test, based on NIOS and C language code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.22mb
    • 提供者:xiao
  1. ALU1

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  2. ALU 指令格式(16位) op DR SR fun 0--3 4—7 8--11 12--15           指令类 OP码 指令 FUN 功能描述 控制 0000  NOP 0000 空指令 HLT 0001 停机 有条件跳转 0010  JZ 0000 Z=1,跳转 JC 0001 C=1,跳转 JNC 0010 C=0,跳转 JNZ 0100 Z=0,跳转 Jump 0101 无条件跳转 LOAD 001
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:1.05kb
    • 提供者:翟志强
  1. P8051

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  2. This a FREE tool chain which compiles C codes into 8051 binary code, converts the binary to RTL ROM, and simulate in Modelsim. SDCC is the compiler. Example compilation: cd compile sdcc --iram-size 0x80 --xram-size 0x800 t8051.c RE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:7.73mb
    • 提供者:zhao xin ke
  1. DE2_LCM_TV_NTSC

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  2. DE2 S O P C 用硬件语言 描述地 开发板上测试 CLM模块 实现视频传输-DE2 SOPC LCM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:223.2kb
    • 提供者:ZHAO
  1. sourcefile

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  2. 在Altera公司的Cyclone系列FPGA开发板上试验的按键中断程序,希望对那些学习中断开发的初学者有帮助。 pio_key.v是verilog编写的按键中断程序,对应四个按键,按其中任何一个键都可以发送一个中断; keyint.c是Nios中编写的C程序,用于检测按键的中断,如果检测到中断,会检测是哪个按键按下,从而执行相应的程序! -In Altera' s Cyclone series FPGA development board interrupt key test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.69kb
    • 提供者:王陶
  1. cnt10

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  2. 这个是eda写10位计数器的示范程序,在试验箱上运行成功-This is eda wrote 10 counter demonstration program, run successfully in the test chamber
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:136.06kb
    • 提供者:吴恒
  1. spi42

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  2. 该代码是为了配合VERILOG的测试,用C++模拟SPI4.2接口的时序功能,需要编译成.dll配合verilog仿真工具一起使用。-The code is in line with VERILOG test, using C++ simulation SPI4.2 interface timing functions, needs to be compiled into a. Dll with the verilog simulation tools.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.73kb
    • 提供者:mb
  1. 84f704a6df6c

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  2. 介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。-MC145159 PLL frequency synthesizer design and realization of PLL frequency synthesizer the basic principles of integrated PLL chip M C 145159 work characteristic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:187.82kb
    • 提供者:KID-hang
  1. CoreI2C

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  2. Actel公司FPGA fusion系列M1AFS600的I2C实验的FPGA程序和keil环境下C语言程序,程序测试通过。-Actel Corporation FPGA fusion experimental series M1AFS600 the I2C FPGA procedures and keil C language programming environment, the program test.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:14.6mb
    • 提供者:卫菊梅
  1. LCD

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  2. Actel fusion M1AFS600的LCD实验,基于周立功公司CortexM1开发板,程序包括FPGA源程序和Keil环境下C语言程序,程序测试通过。-Actel fusion M1AFS600 the LCD test, Zhou, who based the company CortexM1 development board, the program includes FPGA source code and Keil C language programming environm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.95mb
    • 提供者:卫菊梅
  1. ps2KEYtest

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  2. 基于51单片机的PS2键盘的测试c语言程序。-Based on 51 single PS2 keyboard test c language program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:23.99kb
    • 提供者:牛翔宇
  1. blink.c

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  2. Simple AVR Test program. Blinking LED.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:559byte
    • 提供者:iholdap
  1. uart_receive5bytes

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  2. C语言实现CPLD串口接受五个字节,有校验,检验无效不做处理,接续检测接受,注释详细。-C language CPLD five byte serial accept check, test invalid without processing, splice detection to accept detailed notes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:2kb
    • 提供者:杨蕾
  1. vhdl-all-english

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  2. A major obstacle that stands in the way of efficient test response compaction are the unknown values (x-values) captured by scan cells during testing. If test responses with s and the correctness of the compactor inputs cannot be verified at
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:557.04kb
    • 提供者:shankar.m
  1. mem

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  2. 一种用于测试SRAM阵列的MARCH-C算法;使用Verilog语言描述,包括SRAM模块、MRACH-C算法还有testbench-An algorithm for MARCH-C test SRAM array using Verilog language descr iption, including SRAM module, MRACH-C algorithms as well as testbench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:70.25kb
    • 提供者:张云
  1. Xilinx

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  2. 2020 XILINX Vivado ISE IP License最全最可靠License获取方式。 LDPC, CPRI, Turbo, Polar, JESD204B/C HDMI1.4/2.0, MIPI CSI-2, MIPI DSI AXI CAN AXI USB2.0 SD Card Host Reed-Solomon Decoder/Encoder 10G Enthernet MAC 25G Enthernet MAC 40G Enthernet MA
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-04-05
    • 文件大小:1kb
    • 提供者:liyan2020
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