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搜索资源列表

  1. Convolutional encoding and Viterbi decoding with k

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  2. 卷积码编码和维特比解码 当K为7 时 供大家参考Convolutional encoding and Viterbi decoding with k 7 rate 1 2 -convolutional coding and Viterbi decoding when K 7:00 for reference convolutional encoding and Viterbi decoding with k 1 2 7 rate
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:254299
    • 提供者:周小川
  1. conv_code

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  2. 用VHDL实现卷积码编码,该码为(2.1.3)型卷积码。-using VHDL Convolutional coding, the code (2.1.3) - Convolutional Codes.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:855
    • 提供者:武汉
  1. conv_enc

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  2. 卷积码编码,用veriolog实现一个(2,1,3)卷积编码-Convolutional coding, with veriolog implement a (2,1,3) convolutional code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:856
    • 提供者:瑶云城
  1. ViterbiFPGA

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  2. 探讨了CDMA 数字移动通信中的差错控制问题, 研究用约束度K = 9 的卷积编码 和最大似然V iterbi 译码的差错控制方案. 在V iterbi 译码算法中, 提出了原位运算度量、保 存路径转移过程和循环存取幸存路径等方法, 能有效地减少存储量、降低功耗, 使得K = 9 的V iterbi 译码算法可在以单片XC4010 FPGA 为主的器件上实现, 其性能指标符合CD2 MA 数字移动通信IS 95 标准要求. 文中给出了实测的算法性能, 讨论了FPGA 具体实现
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:366845
    • 提供者:tsincons
  1. OFDM_FPGA

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  2. OFDM的FPGA实现 内含卷积编码 交织,频偏检测 完整的OFDM实现代码 -The FPGA contains OFDM convolutional coding to achieve interleaving, OFDM frequency offset detecting the full implementation code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2271386
    • 提供者:何渊泽
  1. conv_enc

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  2. 该程序文档是用verilog实现卷积码的编码和解码,报告中从原理进行详细的分析,代码程序也有详细的备注-The program document is to achieve convolutional code with verilog coding and decoding, the report analysises the principle ,the code also has a detailed program note.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:216722
    • 提供者:飞扬奇迹
  1. FPGA-convolutions-encoder

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  2. 卷积码是数字通信中很重要的一种差错控制编码 具有很好的性能,用硬件的形式描述具有速度快,便于修改的优点,通过该种方法设,计的编码器经测试运行可靠正确。-Convolutional codes are very important in digital communication error control coding with a good performance, with the descr iption of the hardware in the form of a fast, eas
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3844
    • 提供者:will li
  1. VerilogHDL

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  2. 基于verilog convolutional coding 的卷积编码-verilog convolutional coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:170962
    • 提供者:xks
  1. conv_encode

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  2. 基于quartus软件的卷积编码,作为基带发射机的信道编码用-Convolutional coding based on quartus software.as the channel coding with baseband transmitter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:186666
    • 提供者:宏伟
  1. viterbi_hard

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  2. (2,1,3)卷积码编码,硬判决译码;编码是matlab语言,译码是verilog语言-(2,1,3) convolutional code encoding, hard decision decoding coding is matlab language, decoding is verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1628017
    • 提供者:刘星麟
  1. viterbi_soft

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  2. (2,1,3)卷积码编码,软判决译码;matlab语言编码;verilog语言译码;-(2,1,3) convolutional code encoding, soft-decision decoding matlab coding verilog decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2089479
    • 提供者:刘星麟
  1. verilog-juanjima

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  2. 卷积码是一种重要的前向纠错信道编码方式,其纠错性能常常优于分组码,且(2,1,7)卷积码已应用于现代卫星通信系统中。Viterbi译码算法能最大限度地发挥卷积码的优异性能。这里采用Verilog  HDL语言设计出(2,1,7)卷积码的编码器模块和基于Viterbi算法的译码器模块,译码器采用全并行结构,译码速度快-Convolutional code is an important forward error correction channel coding method, and
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:10240
    • 提供者:邓博于、
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