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搜索资源列表

  1. high_speed_tap8_DDS

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  2. 用verilog编写的高速8路并行dds模块,用于与高速da(1ghz或以上)接口产生任意频率正弦波,模块已经经过工程验证,用于产品中。-Verilog prepared with high-speed 8-way parallel dds modules for use with high-speed da (1ghz or above) interface have any frequency sine wave, the module has been proof for the prod
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.83kb
    • 提供者:yangyu
  1. FPGA_DDS

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  2. 基于Cyclone EP1C6240C8 的AD9854 DDS的接口程序,使用FPGA来控制DDS信号的产生,从而达到高频信号产生的目的。 通过FPGA口线模拟AD9854的控制时序。 提供DDS信号波形变换、DDS频率调整、DDS内部比较器使用等功能。-Cyclone EP1C6240C8 of the AD9854 DDS-based interface program, use the FPGA to control the DDS signal generation, so a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-01-18
    • 文件大小:1.74mb
    • 提供者:icemoon1987
  1. AD9954

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  2. 设计背景:近年来现场可编程门阵列( FPGA) 技术得到了迅速的发展和广泛的应用, 其资源容量、工作频率以及集成度都得到了极大的提高, 使得利用FPGA 实现某些专用数字集成电路得到了大家的关注, 而基于FPGA 实现的直接数字频率合成器即DDS(Direct Digital Synthesizer)则更具其优点, 有着灵活的接口和控制方式、较短的转换时间、较宽的带宽、以及相位连续变化和频率分辨率较高等优点, 其也为设计者在此基础之上实现电路集成提供了另一种方法,同D/ A 转换器和低通滤波器(
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:73.67kb
    • 提供者:吴飞飞
  1. 89S52-control-DDS

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  2. 使用89S52单片机控制AD9854 DDS板产生正弦信号,单片机接口采用5V转3.3V元件74LVC4245-89S52 microcontroller control of AD9854 DDS board to produce a sinusoidal signal, the microcontroller interface, 5V to 3.3V components 74LVC4245
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.26kb
    • 提供者:李金良
  1. DDS_total

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  2. quartus下的DDS信号源设计,可实现多种波形不同频率和幅度的切换,人机界面友好。-design the quartus under the DDS source, can achieve a variety of waveforms of different frequencies and amplitude switching, friendly interface.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:602.7kb
    • 提供者:易依
  1. shuanglu_DDS

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  2. 双路DDS,能实现两路同频不同相的各种波形,并附有和STM32的接口程序-Dual DDS, can achieve two different phases of the same frequency of various waveforms, along with and STM32 interface program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:972.7kb
    • 提供者:崔扬
  1. dds_PIO

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  2. 利用QSYS中自带的PIO接口实现DDS模块(Using the PIO interface in QSYS to implement the DDS module)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:17.98mb
    • 提供者:somnus浅眠
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