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  1. 基于VHDL的DDS信号发生器

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  2. 本设计是利用EDA技术设计的电路, 该信号发生器输出信号的频率范围为20Hz~20KHz,幅度的峰 峰值为0.3V~5V两路信号之间可实现0°~359°的相位差。侧重叙述了用FPGA来完成直接数字频率合成器(DDS)的设计
  3. 所属分类:编译

    • 发布日期:2011-05-04
    • 文件大小:363
    • 提供者:meimeisa1
  1. FPGA XP

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  2. 上海安陆FPGA 芯片XP系统 交叉编译平台 操作简单方便。
  3. 所属分类:编译

    • 发布日期:2018-12-19
    • 文件大小:89389163
    • 提供者:jrled@163.com
  1. FPGA基本开发流程

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  2. 文档中包含quartus从安装到使用教程和部分Verilog使用方法加上FPGA开发流程
  3. 所属分类:编译

  1. fpga数据传输

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  2. 将ad采集数据传输到pl端,通过AXI总线传输到PS端的DDR中,通过网口传输。
  3. 所属分类:编译

    • 发布日期:2021-10-01
    • 文件大小:104463229
    • 提供者:wlf123666@_
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