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  1. 数字秒表课程设计

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  2. 秒表程序课程设计,可以让那些不想写设计报告的人直接使用-stopwatch curriculum design process, allowing those who do not want to write the design report directly use
  3. 所属分类:汇编语言

    • 发布日期:2008-10-13
    • 文件大小:18617
    • 提供者:杨天
  1. gaojingdushuzimiaobiao

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  2. 高精度数字秒表,在pc机上用汇编语言模拟普通数字秒表,实现计时,暂停,继续,存储等功能。-high-precision digital stopwatch, the PCs used assembly language simulation ordinary digital stopwatch, time to achieve, suspended, continued, storage.
  3. 所属分类:汇编语言

    • 发布日期:2008-10-13
    • 文件大小:2169
    • 提供者:刘涛
  1. ghdfghhjetet

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  2. 汇编语言实现的数字秒表 汇编语言实现的数字秒表-language compilation of figures compiled language stopwatch figures stopwatch
  3. 所属分类:ListView/ListBox

    • 发布日期:2008-10-13
    • 文件大小:2165
    • 提供者:ah
  1. daima.用VHDL语言设计一个数字秒表

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  2. 用VHDL语言设计一个数字秒表: 1、 秒表的计时范围是0秒~59分59.99秒,显示的最长时间为59分59秒。 2、 计时精度为10MS。 3、 复位开关可以随时使用,按下一次复位开关,计时器清零。 4、 具有开始/停止功能,按一下开关,计时器开始计时,再按一下,停止计时。系统设计分为几大部分,包括控制模块、时基分频模块、计时模块和显示模块等。其中,计时模块有分为六进制和十进制计时器。计时是对标准时钟脉冲计数。计数器由四个十进制计数器和两个六进制计数器构成,其中毫秒位、十毫秒位、秒位和
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-26
    • 文件大小:4767
    • 提供者:SAM
  1. run_watch

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  2. 提供一个数字秒表的EDA设计实例,内故有VHDL源代码,并有运行仿真图。-To provide a digital stopwatch the EDA design example, it is within the VHDL source code, and run the simulation of Fig.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:61824
    • 提供者:靳朝
  1. KESHE

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  2. 基于FPGS的数字秒表设计文件 含有计时,停止,复位,清零功能-FPGS-based digital stopwatch design document contains a time, stop, reset, Clear Function
  3. 所属分类:Project Design

    • 发布日期:2017-04-26
    • 文件大小:296369
    • 提供者:豆豆
  1. digitalStopwatch

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  2. 数字秒表的设计,设计并调试一个计时范围为0.01秒~1小时的数字秒表,并用实验开发系统进行硬件验证。有详细步骤和源码。-The digital stopwatch s design, designs and debugs a time scope is 0.01 second ~1 hour digital stopwatch, and carries on the hardware confirmation with the experiment development system. Has
  3. 所属分类:File Formats

    • 发布日期:2017-03-30
    • 文件大小:79677
    • 提供者:风琴
  1. Seconds

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  2. 使用Keil开发的数字秒表,四位LED显示,具有暂停,清零功能,单片机课程设计。内附单片机原理图,程序注释详细,本人亲写。-Keil development using digital stopwatch, four LED display, with the suspension, Clear function, single-chip design courses. Containing a single-chip schematics, procedures detailed notes,
  3. 所属分类:SCM

    • 发布日期:2014-04-17
    • 文件大小:182972
    • 提供者:cxsys
  1. stopwatch

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  2. 基于vhdl的数字秒表,计时精度为1/100秒,最长计时时间为59分59.59秒;设有复位开关、起停开关;验证可用。-On vhdl digital stopwatch, timing accuracy of 1/100 seconds, the longest time time of 59 minutes 59.59 seconds with reset switch, start-stop switches validation is available.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:265845
    • 提供者:ly
  1. vhd_design

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  2. 我学习VHDL的课程设计,是多功能数字钟,有闹钟,秒表等功能,多指教-I learned VHDL course design is multi-functional digital clock, there is an alarm clock, stopwatch functions, multi-Zhi Jiao
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:348691
    • 提供者:GUO-xc
  1. stopwatch

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  2. 数字秒表的VHDL代码。当设计文件加载到目标器件后,设计的数字秒表从00-00-00开始计秒。,直到按下停止按键(按键开关S2)。数码管停止计秒。按下开始按键(按键开关S1),数码管继续进行计秒。按下复位按键(核心板上复位键)秒表从00-00-00重新开始计秒。-The VHDL code for digital stopwatch. When the design document loaded into the target device, the designed digital stop
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-11
    • 文件大小:1457
    • 提供者:王唐小菲
  1. digital_second_clock

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  2. 设计一块数字秒表,能够精确反映计时时间,并完成复位、计时功能。-Design a digital stopwatch, the time to accurately reflect the time and complete the reset, timing functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:464817
    • 提供者:刘智虎
  1. 5

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  2. 基于FPGA的数字秒表的VHDL设计,论文,有主要程序-FPGA-based VHDL design digital stopwatch, paper, a major program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:608
    • 提供者:孤星寒
  1. 3

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  2. 】文章介绍了用于体育比赛的数字秒表的VHDL 设计, 并基于FPGA 在MAXPLUS2 软件下, 采用ALTRA 公司FLEX10K 系列的EPF10K10LC84- 4 芯片进行了计算机仿真-】 This article introduces digital stopwatch for sports competition in the VHDL design and FPGA-based software in MAXPLUS2, using ALTRA company FLEX10K
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:50273
    • 提供者:孤星寒
  1. multisim

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  2. 基于Multisim软件设计的数字秒表电路课程设计报告-Multisim software design based on digital stopwatch circuit course design report
  3. 所属分类:SCM

    • 发布日期:2017-03-27
    • 文件大小:233454
    • 提供者:李浩源
  1. Digital-stopwatch-design

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  2. 数字秒表的设计报告,用VHDL语言编写程序,实现分析讨论中各种功能,分别进行编译并生成相应的模块,然后将这些模块连接起来形成电路图,并进行编译、仿真。-Digital stopwatch design reports, using VHDL language programming, analysis and discussion of various functions to achieve, respectively, to compile and generate the correspo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:375786
    • 提供者:吴亮
  1. 基于单片机秒表系统设计

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  2. 基于单片机课程设计_秒表系统设计(汇编),其中有设计介绍及用汇编语言写的关于数字秒表的程序-Based on the microcontroller course design _ stopwatch system design (assembly), which design introduced a program written in assembly language on digital stopwatch
  3. 所属分类:汇编语言

    • 发布日期:2013-04-24
    • 文件大小:184523
    • 提供者:王语
  1. 秒表

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  2. 数字钟的精度、稳定度远远超过老式机械钟。在这次设计中,我们目前只采用LED数码管显示秒来显示最高秒为99秒的方式,根据数码管动态显示原理来进行显示,用基于C52单片机、12MHz的晶振产生振荡脉冲。(The accuracy and stability of the digital clock are much higher than that of the old mechanical clock. In this design, we only use LED digital display
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2017-12-17
    • 文件大小:8192
    • 提供者:tzh123
  1. 简易秒表设计

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  2. 用8031单片机实现简易秒表功能并用八段数码管显示。按下启动键,不管原来显示何值,均先从零开始。按下停止键时停止,数字保持不变。显示时间最长为9秒后停止,数字保持为“9”。按下复位键后,数字显示“0”。(A simple stopwatch function is realized with 8031 singlechip and eight segments are used to display it. Press the start key, regardless of the origi
  3. 所属分类:嵌入式/单片机/硬件编程

    • 发布日期:2018-04-29
    • 文件大小:393216
    • 提供者:pczx2012
  1. 课程设计-数字钟

    2下载:
  2. 具有计时 设置时间 闹钟 秒表 功能的数字钟设计 外设矩阵键盘(Digital clock design peripheral matrix keyboard with the function of timing setting time alarm clock stopwatch)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-07-15
    • 文件大小:13769728
    • 提供者:peennnnnn
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