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搜索资源列表

  1. Crack_QII81_FULL_License

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  2. quartus 8.1 ipcore lic,包含ddr、ddr2、fir、nco-quartus 8.1 ipcore lic, with ddr, ddr2, fir, nco
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:29537
    • 提供者:wcm
  1. DDR_SDRAM_controller

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  2. DDR SDRAM控制器的VHDL源代码,含详细设计文档。 The DDR, DCM, and SelectI/O™ features in the Virtex™ -II architecture make it the perfect choice for implementing a controller of a Double Data Rate (DDR) SDRAM. The Digital Clock Manager (DCM) provides t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:131924
    • 提供者:xbl
  1. AlteraCycloneIIFPGAStarterBoard

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  2. Altera Cyclone II FPGA Starter Board原理图-Altera Cyclone II FPGA Starter Board Schematic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:236298
    • 提供者:王辉
  1. ddr_sdr_V1_1

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  2. DDR控制器 - 用XILINX Virtex II FPGA实现 - 使用DDR MT46V16M16作为仿真模型 - 通用化-DR SDRAM Controller Core - has been designed for use in XILINX Virtex II FPGAs - works with DDR SDRAM Device MT46V16M16 without changes - may be easily adapted
  3. 所属分类:VHDL编程

    • 发布日期:2012-12-20
    • 文件大小:37782
    • 提供者:jordanliang
  1. ddr-sdram-verilog-resource

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  2. 描述了ddr_sram的源代码,包括SDRAM的引脚功能介绍和Verilog在modulesim及quartus ii的实现-descr iption the resource code of ddr_sram
  3. 所属分类:Other systems

    • 发布日期:2014-09-10
    • 文件大小:896360
    • 提供者:wangyuzhuo
  1. SDRAM

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  2. 连接Nios II 和SDRAM的系统设计,DDR SDRAM设计及调试经验总结,MT48LC16M16资料。-failed to translate
  3. 所属分类:Project Design

    • 发布日期:2017-05-08
    • 文件大小:1903112
    • 提供者:luyi
  1. DDR SDRAM Design Tutorials

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  2. Altera公司的基于NIOSII设计DDR和DDR2内存的资料,很有帮助的,-Based on Altera' s DDR and DDR2 memory NIOSII design information, useful,
  3. 所属分类:VHDL编程

    • 发布日期:2013-01-18
    • 文件大小:3155168
    • 提供者:iyoung
  1. SDRAM_DDR_DDR-II_Rambus_DRAM

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  2. 内存的原理和时序(SDRAM、DDR、DDR-Ⅱ、Rambus_DRAM)-The principle and the timing of the memory (SDRAM, DDR, DDR-II, Rambus_DRAM)
  3. 所属分类:Linux-Unix program

    • 发布日期:2017-05-23
    • 文件大小:7368500
    • 提供者:李先生
  1. DDR-with-CoolRunner-II

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  2. 详细讲解了CoolRunner II CPLD与DDR SDRAM的接口设计-Explained in detail about the design of the CoolRunner II CPLDs and DDR SDRAM interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:368351
    • 提供者:yanghengxu
  1. CycloneIII_EP3C40F780C8_26_DDRII

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  2. SOPC,CycloneIII系列芯片EP3C40F780C8,NIOS II IDE,DDR II测试实验代码-SOPC,CycloneIII,EP3C40F780C8,NIOS II IDE, DDR II code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:7597828
    • 提供者:leiyitan
  1. ddr_sdr

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  2. DDR SDRAM Controller Core - has been designed for use in XILINX Virtex II FPGAs - works with DDR SDRAM Device MT46V16M16 without changes - may be easily adapted to any other DDR SDRAM device-DDR SDRAM Controller Core - has been designe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:37768
    • 提供者:aa
  1. ddr_sdram

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  2. 包含ddr_sdr_conf_pkg.vhd,reset.vhd,ddr_dcm.vhd,user_if.vhd,ddr_sdram.vhd,Mt46v16m16.vhd以及仿真TB文件;设计采用Virtex ii系列芯片,DDR_SDRAM型号为Mt46v16m16,可用于进行DDR控制的初步学习使用;通过细致了解并进行逻辑控制,可深入理解DDR芯片内部构造; 支持133MHz系统时钟频率,突发长度为2,可进行读、写、NOP、激活、自刷新配置、预充电以及各ROW/BANK的激活改变等动作,较
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-28
    • 文件大小:20480
    • 提供者:唛侬
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