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搜索资源列表

  1. FIFO

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  2. FIFO的功能众所周知,非常好的处理时序问题。(The functions of FIFO are known to be very good at dealing with timing problems.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-13
    • 文件大小:1240
    • 提供者:FollowSky
  1. SCI.fifo

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  2. DSP2812SCI通信程序,采用 fifo模式(DSP2812SCI communication procedures, using fifo mode)
  3. 所属分类:其他

    • 发布日期:2017-12-24
    • 文件大小:88064
    • 提供者:是雕
  1. FIFO Design Using Verlilog

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  2. DFF with fifo concepts
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:92160
    • 提供者:logu.am
  1. FIFO Details

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  2. FIFO Design PDF files
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:1645568
    • 提供者:logu.am
  1. fifo

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  2. 学习Clifford_E论文之后完成的异步FIFO,可以完成异步时钟下的数据同步(After learning Clifford_E paper, the asynchronous FIFO can be completed under asynchronous clock data synchronization)
  3. 所属分类:其他

    • 发布日期:2017-12-26
    • 文件大小:2048
    • 提供者:WWYMM
  1. OV7670+FIFO+3.0TFT

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  2. ov7670 + FIFO原理,入门,简述,应用(Ov7670 + FIFO principle, introduction, brief descr iption, application)
  3. 所属分类:单片机开发

    • 发布日期:2017-12-21
    • 文件大小:10240
    • 提供者:18288292104
  1. FIFO

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  2. STM32通过与FPGA通信读取FPGA的串行FIFO(STM32 and FPGA FIFO communication)
  3. 所属分类:其他

    • 发布日期:2017-12-25
    • 文件大小:9152512
    • 提供者:k77
  1. DSP读写基于FPGA的FIFO

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  2. 本文档提供了DSP对FPGA中的FIFO的读写时序以及编程思路,供大家参考。(This document provides DSP on the FPGA FIFO read and write timing and programming ideas for your reference.)
  3. 所属分类:其他

    • 发布日期:2017-12-26
    • 文件大小:987136
    • 提供者:wangxiaobei
  1. 异步FIFO设计

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  2. 经典的异步FIFO设计,First Input First Output的缩写,先入先出队列,这是一种传统的按序执行方法,先进入的指令先完成并引退,跟着才执行第二条指令。(Classic asynchronous FIFO design)
  3. 所属分类:其他

  1. 同步FIFO设计

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  2. First Input First Output的缩写,先入先出队列,这是一种传统的按序执行方法,先进入的指令先完成并引退,跟着才执行第二条指令。(Classic synchronous FIFO design)
  3. 所属分类:其他

  1. FIFO

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  2. 提供的是页面置换算法中最简单的先进先出策略的java代码实现(The Java code implementation of the simplest FIFO policy in the page replacement algorithm is provided)
  3. 所属分类:Windows编程

    • 发布日期:2017-12-31
    • 文件大小:1024
    • 提供者:Bruce Shen
  1. FIFO

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  2. 简单fifo填入和读取的代码,供大家参考(simple demo code of FIFO)
  3. 所属分类:matlab例程

    • 发布日期:2018-01-06
    • 文件大小:76800
    • 提供者:hustskyline
  1. fifo

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  2. 每一个时钟(clk_100m)上升沿,判断写请求信号是否为高电平,如果为高电平,那么就将数据线上的数据写入FIFO,然后在下一个时钟上升沿,wrf_use增加1,表示FIFO队列里的数据增加了一个。 细心的朋友可能会发现,其实在这一过程中,读请求信号一直为高电平,仔细分析这两张图片,大概可以得出如下判断: 在每个读时钟的上升沿,首先判断读请求信号是否为高电平,若为高电平,再判断FIFO是否为空,如果不为空,那么在下一个read_clock的上升沿将数据读出(us QuartusII desi
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:47104
    • 提供者:及个
  1. Asynchronous FIFO Architectures

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  2. 老外的经典异步FIFO结构讲解,一共三个部分。(Asynchronous FIFO Architectures Vijay A. Nebhrajani)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-11
    • 文件大小:200704
    • 提供者:啸傲.
  1. fifo

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  2. 基于verilog HDL的fifo设计与测试,包含设计与测试代码,以及简单的makefile编写。整个平台是基于linux操作,仿真平台是基于SYNOPSYS的vcs工具。(Based on verilog HDL fifo design and testing, including the design and test code, and simple makefile.The platform is based on Linux operating, the simulation pla
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-20
    • 文件大小:15360
    • 提供者:yzzls
  1. fifo页面置换算法模拟程序

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  2. fifo页面置换算法模拟程序 1.请求分页的置换算法(FIFO && RUL算法实现);2.按给定的顺序列,输出页面调度过程包括命中 / 缺页,调入/调出;3.计算缺页率,频率。(FIFO page replacement algorithm simulation program)
  3. 所属分类:其他

    • 发布日期:2018-04-23
    • 文件大小:1024
    • 提供者:安安010
  1. 无FIFO摄像头 DMA传送

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  2. 该程序是使用了无fifo的7670摄像头,使用dma传输方式,能够稳定传输图像(The program uses a FIFO - free 7670 camera and uses DMA transmission to stabilize the transmission of the image)
  3. 所属分类:单片机开发

    • 发布日期:2018-04-23
    • 文件大小:16634880
    • 提供者:tgy112
  1. FIFO

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  2. FIFO code in verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-23
    • 文件大小:1024
    • 提供者:shahzadsaahil
  1. 异步FIFO

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  2. 自己编写的同步和异步FIFO的verilog代码,验证过,有可靠性(Verilog code of my own synchronous and asynchronous FIFO, verified,and reliable.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:2048
    • 提供者:大黄黄黄
  1. fifo

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  2. fifo模块,改模块使用同步fifo设计,里面包含一些设计技巧,读延迟最少(The module of FIFO is modified by using synchronous FIFO, which contains some design skills and the least latency.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-06
    • 文件大小:3072
    • 提供者:林林明
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