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搜索资源列表

  1. DDS_VHDL_xzy

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  2. 在EDA开发软件QuartusII上利用VHDL语言实现DDS信号发生器,芯片是Altera公司的-in EDA software development QuartusII use VHDL DDS signal generator , chip companies are Altera
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4761129
    • 提供者:xiaoyong
  1. 成功将QuartusII中生成的dds波形数据的tbl文件导入MATLAB中

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  2. 成功将QuartusII中生成的dds波形数据的tbl文件导入MATLAB中,实现十六进制数值转化成figure图形。-Successfully QuartusII dds waveform data generated in the tbl file into MATLAB, to achieve the hex value into figure drawing.
  3. 所属分类:matlab例程

    • 发布日期:2014-05-12
    • 文件大小:1024
    • 提供者:
  1. test_ad9852

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  2. 使用FPGA来控制DDS信号的产生,从而达到高频信号产生的目的。使用的DDS芯片为AD9852,在QuartusII下编写。-Using the FPGA to control the DDS signal generation, so as to achieve high-frequency signal generation purposes. Use of DDS chip AD9852, in the QuartusII prepared.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:937
    • 提供者:
  1. dds

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  2. verilog语言编写,在Quartus II里仿真DDS的产生,包括所有仿真生成的相关文件,-verilog language in the Quartus II DDS in the generation of simulation, including all documents generated by the simulation,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:3013196
    • 提供者:颜小超
  1. dds

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  2. 这是一个用vhdl语言实现dds的例子,已在quartusII里调通并可以下载到实验箱上,功能正确-This is a use of VHDL language dds example, has been in tune quartusII pass and can be downloaded to the experimental box, the function correctly
  3. 所属分类:OS Develop

    • 发布日期:2017-03-29
    • 文件大小:331839
    • 提供者:leezhihui
  1. 75448152Project1-DDS

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  2. 利用DDS芯片实现正弦波输出 使用synplify pro建立工程,加入这些文件 编译后生成.vqm的文件 用quartusII打开.vqm文件,编译通过 加入.vwf波形仿真文件,进行波形仿真 最后分配引脚,下载即可 - realization of sin wave in FPGA
  3. 所属分类:Document

    • 发布日期:2017-04-15
    • 文件大小:8615
    • 提供者:echo
  1. dds_test

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  2. 使用图形编辑法(block模式)编写的全套DDS部分,应用于FPGA,开发环境为QuartusII。形象直观,用户可以直接生成代码另行应用-The use of graphic editing method (block mode) part of the preparation of the full range of DDS used in FPGA, the development environment QuartusII. Visual image, the user can be d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:4131614
    • 提供者:wanghaosen
  1. DDS

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  2. DDS频率合成器(使用VHDL硬件描述语言,通过Altera QuartusII开发)-DDS frequency synthesizer (using VHDL hardware descr iption language, through the development of Altera QuartusII)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:233900
    • 提供者:刘磊
  1. FPGAdds

    0下载:
  2. 用verilog写的DDS程序,请用QuartusII 8.1以上版本打开-DDS program written using verilog, please QuartusII 8.1 or later to open
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1614326
    • 提供者:吴恒
  1. mcu-fpga

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  2. 目录 FPGA & MCU 开发板介绍 实验1 QuartusII 软件应用 实验2 Keil C51 应用 实验3 字符型LCD YM1602 的应用 实验4 带字库的中文LCD YM12864 的应用 实验5 时钟芯片DS1302 的应用 实验6 I2C 总线器件AT24C64 的应用 实验7 数字温度传感器的应用 实验8 行列式键盘 实验9 硬件电子琴的设计 实验10 AD 与DA 的使用 实验11 简易DDS 信号源设计 实验12 用模
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-08-02
    • 文件大小:1640448
    • 提供者:lyy
  1. exp2prj1

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  2. 基于FPGA的DDS,编写语言为verilogHDL,编辑环境为quartusII 9.0,dds频率可程控调节-a Direct Digital Synthesis based on FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1002436
    • 提供者:yzy
  1. DDS

    0下载:
  2. 这个是在quartusii和matlab simulink下搭的dds的模型,已经经过仿真是可以的。并且已经转为vhdl代码。-This is quartusii and matlab simulink model to catch the dds, has been the simulation is possible. And has to vhdl code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1288325
    • 提供者:jiang
  1. dds_wave

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  2. 基于数字频率合成技术DDS,在quartusii编写相关代码,实现正弦信号输出,同时可以实现调幅、调频和数码管闲事-Based on the digital frequency synthesis technology of DDS, written in QuartusII code, achieve sinusoidal signal output, and can achieve amplitude modulation, frequency modulation and digital
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9920058
    • 提供者:sunyanjuan
  1. FPGA-DDS

    0下载:
  2. 基于FPGA的DDS实现QuartusII工程和论文-Based on the FPGA DDS QuartusII project and paper
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:5077426
    • 提供者:左向利
  1. dds_generater

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  2. 波形发生器,可以生成正弦波、三角波、方波、锯齿波;可以选择输出频率和幅度,基于DDS设计,verilog和QuartusII开发-Waveform generator can generate sine, triangle, square wave, sawtooth wave you can the output frequency and amplitude, DDS-based design, verilog and development QuartusII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5154290
    • 提供者:zhang
  1. DDS(ok)

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  2. 制作ROM正弦表并填充FPGA内部ROM,通过调用内部数据实现正弦波输出,开发环境quartusii , 语言verilog , 调试通过 , 附有modelsim调试结果。-Make ROM sine table and fill the ROM internal FPGA, by calling the internal data to achieve the sine wave output, development environment QuartusII, Language Veri
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:10149508
    • 提供者:PrudentMe
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