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搜索资源列表

  1. Static_Timing_Analysis

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  2. Altera Quartusii静态时序分析(Static Timing Analysis)基础及应用
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:674316
    • 提供者:张力
  1. wjnce-CAMERA

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  2. 基于wince的底层驱动,用于生成dll的原始代码,本程序主要针对于sangsumg6410外围设备(camera)的驱动有严格的时序分析-Based on the underlying drivers wince, the original code used to generate the dll, the program aimed at sangsumg6410 peripherals (camera) driver has strict timing analysis
  3. 所属分类:Windows CE

    • 发布日期:2017-04-05
    • 文件大小:426402
    • 提供者:meng
  1. TimingDesigner

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  2. 非常简单易用的画时序图工具,用于时序设计、流程分析很实用-Very easy to use timing diagram drawing tool for timing design, flow analysis is very useful
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2016-01-25
    • 文件大小:3673755
    • 提供者:jakeywym
  1. CRC

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  2. 这个是我花了一个星期的CRC算法,有并行与串行的区别与时序的分析。。。。希望站长能够同意-This is a week I spent the CRC algorithm, there is the difference between parallel and serial and timing analysis. . . . Hope that regulators can not agree
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-02
    • 文件大小:752170
    • 提供者:heshuiming
  1. DDR

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  2. 关于DDR SDRAM的详细原理和时序分析,对于开发设计有很大使用价值-DDR SDRAM on detailed principles and timing analysis, design for the development of a great value
  3. 所属分类:Project Design

    • 发布日期:2017-04-09
    • 文件大小:2201704
    • 提供者:王平
  1. CTune0.9

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  2. 主要用于时序分析,无论是ASIC还是FPGA以及DSP都很有效的.欢迎大家使用-Mainly used for timing analysis, whether it is ASIC or FPGA and DSP are very effective. Welcome to use
  3. 所属分类:DSP program

    • 发布日期:2017-03-30
    • 文件大小:110457
    • 提供者:大赛分
  1. Static_Timing_Analysis

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  2. 静态时序分析设计的经典教程书籍 全面,权威的讲解,丰富的内容举例-Static timing analysis tutorial books classic design a comprehensive, authoritative presentation, rich content, for example
  3. 所属分类:Document

    • 发布日期:2017-03-30
    • 文件大小:674039
    • 提供者:zhangxudong
  1. StaticTimingAnalysis

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  2. 静态时序分析(Static Timing Analysis简称STA)经由完整的分析方式判断IC是否能够在使用者的时序环境下正常工作,对确保IC质量之课题,提供一个不错的解决方案。然而,对于许多IC设计者而言,STA是个既熟悉却又陌生的名词。本文将力求以简单叙述及图例说明的方式,对STA的基础概念及其在IC设计流程中的应用做详尽的介绍。-Static timing analysis (Static Timing Analysis referred to as STA) through a com
  3. 所属分类:Static control

    • 发布日期:2017-03-29
    • 文件大小:726052
    • 提供者:王铭义
  1. static_time_analysis

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  2. Static Timing Analysis is a method of computing the expected timing of a digital circuit without requiring simulation.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-04
    • 文件大小:7527
    • 提供者:ankit
  1. PrimeTime_Advanced_Timing_Analysis_User_Guide

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  2. PrimeTime Advanced Timing Analysis User Guide
  3. 所属分类:Development Research

    • 发布日期:2017-05-09
    • 文件大小:1959251
    • 提供者:kerwin fu
  1. modelsim-timing-analysis

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  2. 自己整理的一个关于如何使用modelsim进行功能仿真,时序仿真和布局布线的后仿真的文档,例子是抄的,针对的版本是modelsim se6.2b-Their finishing a feature on how to use modelsim for simulation, timing simulation and post-layout simulation of the document, copy the example is for the version of modelsim se
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:705918
    • 提供者:雍振强
  1. analysis

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  2. 很经典的华为时序分析资料,用于电路的时序分析-Huawei is the classic time series analysis data for circuit timing analysis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:699336
    • 提供者:hemiao
  1. Maxplus-timing-simulation

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  2. 主要介绍Max_plus_的时序仿真与时序分析,对刚入门的很有帮助意义。-Introduced Max_plus_ timing simulation and timing analysis, meaning just getting started helpful.
  3. 所属分类:Windows Develop

    • 发布日期:2017-05-04
    • 文件大小:1224812
    • 提供者:Aaran
  1. Timing-analysis

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  2. FPGA玩转Altera之时序篇,包括时序分析注意事项-Altera play the FPGA XuPian, including timing analysis the matters needing attention
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:16743933
    • 提供者:蔡历鑫
  1. Timing-Analysis

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  2. 关于VHDL/VERILOG进行EDA设计时序分析时需要注意的一些需要注意的问题及处理策略,保证相当实用,请需要的人参考-VHDL/VERILOG the EDA design timing analysis need to pay attention to some issues that need attention and treatment strategies, guaranteed to be quite practical, please need Reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:10623955
    • 提供者:张炽
  1. Timing

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  2. 国外关于时序设计的一本非常好的书,写得非常详细,包括时序的分析的原理-Abroad on timing design of a very good book, written in great detail, including the principle of timing analysis, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5533930
    • 提供者:linhanxiong
  1. timing

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  2. FPGA设计时序约束及时序分析资料。详细介绍了时序约束中的基本概念、常用约束、如何分析时序等。-FPGA design timing constraints and timing analysis. Details of the timing constraints of the basic concepts, common constraints, such as how to analyze timing.
  3. 所属分类:IT Hero

    • 发布日期:2017-05-10
    • 文件大小:2521412
    • 提供者:kan
  1. IO-timing-constrain-in-fpga

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  2. 对FPGA的IO口的时序分析小结,能够详细理解其约束时序规则-FPGA timing analysis summary of IO port, capable of a detailed understanding of its timing constraint rules
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:189376
    • 提供者:张龙
  1. altera-timing

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  2. Altera时序分析基础,帮助提升时序分析能力,建立时序分析模型。-The base of Altera timing analysis.
  3. 所属分类:software engineering

    • 发布日期:2017-05-05
    • 文件大小:531089
    • 提供者:王欢
  1. Static Timing Analysis

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  2. 静态时序分析,有很详细的例子和图标说明,对于FPGA工程师非常有用,对于IC工程师也非常有用!(Static timing analysis, there are very detailed examples and icon descr iptions.)
  3. 所属分类:文章/文档

    • 发布日期:2018-05-07
    • 文件大小:4658176
    • 提供者:姚小菜123
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