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sqrt32
- verilog源代码，用于开根号计算（32位）-sqrt32.v sqrt of 32-bit integer, Verilog source
PIPE_LINING_CPU_TEAM_24
- 采用Quatus II编译环境，使用Verilog HDL语言编写实现了五段流水线CPU。 能够完成以下二十二条指令（均不考虑虚拟地址和Cache，并且默认为小端方式）： add rd,rs,rt addu rd,rs,rt addi rt,rs,imm addiu rt,rs,imm sub rd,rs,rt subu rd,rs,rt nor rd,rs,rt xori rt,rs,imm clo rd,rs clz rd,rs slt rd,rs,rt sltu rd,
Haffmancode
- 课程设计： 1.求出在一个n×n的棋盘上，放置n个不能互相捕捉的国际象棋“皇后”的所有布局。 2.设计一个利用哈夫曼算法的编码和译码系统，重复地显示并处理以下项目，直到选择退出为止。 【基本要求】 1) 将权值数据存放在数据文件(文件名为data.txt，位于执行程序的当前目录中) 2) 分别采用动态和静态存储结构 3) 初始化：键盘输入字符集大小n、n个字符和n个权值，建立哈夫曼树； 4) 编码：利用建好的哈夫曼树生成哈夫曼编码； 5) 输出编码； 6)
vh2sc
- 将VHDL转换为C的软件 将VHDL转换为C的软件-VH2SC is a free basic VHDL to SystemC converter. The converter handles a small subset of Synthesisable VHDL 87/93 language constructs. The current version translates all VHDL IEEE types to sc_int/sc_uint/integers and boole
xvidcore
- MPEG4 xvid 编解码 源程序 v 1.32-MPEG4 xvid encoder and decoder v 1.32
Windows_Driver_Programming_Tutorial
- 第一章 字符串 6 1.1 使用字符串结构 6 1.2 字符串的初始化 7 1.3 字符串的拷贝 8 1.4 字符串的连接 8 1.5 字符串的打印 9 第二章 内存与链表 11 2.1内存的分配与释放 11 2.2 使用LIST_ENTRY 12 2.3 使用长长整型数据 14 2.4使用自旋锁 15 第三章 文件操作 18 3.1 使用OBJECT_ATTRIBUTES 18 3.2 打开和关闭文件 18 3.3 文件的读写操作 21
stm32f10x_stdperiph_lib_v3.0.0
- The STM32F10x Standard Peripheral Library v 3.0.0 is a complete package, consisting of device drivers for all of the standard device peripherals, for High-, Medium- and Low- Density Devices 32-bit Flash microcontrollers. -The STM32F10x Standard Perip
newsManager
- 系统运行说明 一、JDK配置 请参照文档 jdk配置方法.doc 二、服务器配置 直接安装 service文件夹下的apache-tomcat-6.0.32.exe 文件 默认用户名和密码都为空 三、数据库配置 a)修改sqlserver数据库登陆方式 为 windows 和 sa 登陆 修改 sa 密码为 123456 b)必须先安装data文件夹下的SQL2000-KB884525-SP4-x86-CHS.EXE 补丁 c)附加数据库 data文件夹下的NEWSMA
am29bdd160g
- 16 Megabit (1 M x 16-bit/512 K x 32-Bit), amd 公司 2.5 V电压, flash存储器仿真读写verilog 模型。-16 Megabit (1 M x 16-bit/512 K x 32-Bit), CMOS 2.5 Volt-only Burst Mode, Dual Boot, Simultaneous Read/Write Flash Memory verilog model.
fPGA_LED
- FPGA开发板做的一个简单LED驱动，使用Verilog语言实现- This is an example of a simple 32 bit up-counter called simple_counter.v It has a single clock input and a 32-bit output port module simple_count(input clock , output end of module counter
bin2chuan
- 在FPGA开发板上座的输出波形的实验，输出波形通过示波器显示出来-// This is an example of a simple 32 bit up-counter called simple_counter.v // It has a single clock input and a 32-bit output port module simple_count(input clock , output reg [31:0] counter_out) always
Desktop
- 实现一个32位高精度的filter输出，内含.v文件，使用verilog-A 32-bit high-precision filter output, containing v file using verilog
dianzhao_dianzhen
- 使用altera的MAX2系列CPLD驱动16*32的双色点阵屏，包含“空车”，“重车”，“电召”三个字。driver.v文件用cpld驱动了东芝的TC62D748芯片，该芯片常用于扫描点阵的驱动上-The MAX2 series CPLD using altera-color dot matrix display driver 16* 32, with " empty" , " heavy vehicles" , " on-call" in t
MIPS32
- 此資料夾為實現一單一時脈週期MIPS32處理器架構源碼，包含了控制單元、資料記憶體、資料路徑、指令記憶體四個部分，以程式碼: (共10個) instruction_mem.v、data_mem.v control.v、alu_control.v program_counter.v、reg_file.v alu_32bit.v、adder_32.v、sign_extend.v來實現。-MIPS (originally
hufferman
- 用下表给出的字符集和频度的实际统计数据建立哈夫曼树，并实现以下报文的编码和译码：“THIS PROGRAM IS MY FAVORITE”字符 A B C D E F G H I J K L M 频度 64 13 22 32 103 21 15 47 57 1 5 32 20 字符 N O P Q R S T U V W X Y Z 频度 57 63 15 1 48 51 80 23 8 18 1 16 1-The actual statistics of the character set a
CRC
- CRC校验参考设计Verilog代码,crc8,16,32bit- crc8_8.v : CRC-8, 8-bit data input. crc12_4.v : CRC-12, 4-bit data input. crc16_8.v : CRC-16, 8-bit data input. crc_ccit_8.v : CRC-CCIT, 8-bit data input.
crc_peripheral32
- 附件是32位循环冗余校验码的硬件语言（v语言）实现。-Attached is a hardware language 32 cyclic redundancy check code (v language) implementation.
PID
- PID： LDP #DP_B01 数据页4——0200h～0280h SETC SXM 允许符号扩展 LACL VREF Vref，Q.15*256 SUB V V，Q.15*256 SACL VE2 e(k)= Vref－V，Q15*256 SUB VE1 e(k-1)，Q15*256 SACL PIDTMP1 Delta(e(k))=e(k)-e(k－1)，Q15/256 SUB
xa_tgsi
- Determines if V(N,K) fits in a 32-bit unsigned integer. N and K are themselves limited to 15 bits.
Java
- 用16位指令编制程序，处理32位加减乘除算术四则运算题。 V=((X-Y)*Z+20)/X -With 16 programmed instruction, handling 32 arithmetic operation arithmetic four questions: V = ((XY)* Z+ 20)/X