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搜索资源列表

  1. Crossover-design

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  2. 在Altera DE2-70的开发板上实现分频计设计。-In the Altera DE2-70 development board to achieve crossover meter designs.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2824123
    • 提供者:柴贤臣
  1. frequency-meter-design

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  2. 在Altera DE2-70的开发板上实现频率计设计。-Achieve frequency meter design Altera DE2-70 development board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3438964
    • 提供者:柴贤臣
  1. DE2_70_VGA_pattern_gen

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  2. 基于DE2-70的VGA彩条产生程序,适合初学者理解VGA的工作原理-VGA pattern generate in DE2-70
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:26671
    • 提供者:黄功成
  1. DieuKhienLed

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  2. dieu khien led DE2-70
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:331244
    • 提供者:hai
  1. FullAdder

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  2. full adder verilog de2-70
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:211519
    • 提供者:hai
  1. DE2_LED_sm

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  2. 驱动DE2—70开发板上数码管,并设计了一个时钟计数器,时钟计数时,分,秒。-DE2 70 development board driver digital tube, and designed a clock counter, clock count, minutes, seconds.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:861022
    • 提供者:李桐
  1. LCD

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  2. LCD的循环输出,在Quartus二的环境下进行开发,DE2-70的开发板,用VHDL语言编写-LCD de xúnhuán shūchū, zài Quartus èr de huánjìng xià jìnxíng kāifā,DE2-70 de kāifā bǎn, yòng VHDL yǔyán biānxiě
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:627551
    • 提供者:王鲁苏
  1. my_example

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  2. 基于SOPC构建的CPU,用DE2-70做的LCD显示,用c语言进行编写。-Based on SOPC built CPU, LCD display with DE2-70 do with the c language written.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2091894
    • 提供者:天题
  1. SOPC_LCD

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  2. 基于SOPC构建的CPU,用DE2-70做的LCD显示,用c语言进行编写。-Based on SOPC built CPU, LCD display with DE2-70 do with the c language written.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2091208
    • 提供者:天题
  1. DE2P_TOP

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  2. DE2-70管脚定义,包含wm8731控制所需的所有引脚-The DE2-70 pin definition, contains all the pin wm8731 control need
  3. 所属分类:Compiler program

    • 发布日期:2017-04-15
    • 文件大小:5966
    • 提供者:sky
  1. paobiao

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  2. verilog实现数码跑表,基于ALTERA DE2—70开发板实现验证,其中代码不分模块。-verilog achieve digital stopwatch, to achieve certification based ALTERA DE2-70 development board, regardless of where the code module.
  3. 所属分类:Other systems

    • 发布日期:2017-04-30
    • 文件大小:491442
    • 提供者:王亚斌
  1. Lcd_800_480

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  2. 基于DE2-70开发板的FPGA和NIOS系统设计的LCD(800-480)液晶显示控制系统的程序设计。-DE2-70 FPGA-based development board and the NIOS system design LCD (800-480) LCD control system programming.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:18913373
    • 提供者:张良
  1. DE2_70_CAMERA

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  2. 这是基于de2-70的d5m摄像头控制还可以在vga上输出640x480的图像 -This is based on d5m camera control de2-70 can also output a 640x480 image on the vga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2517452
    • 提供者:汪洋
  1. keyscanverilog

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  2. 基于DE2-70开发板的四个按键KEY0-KEY3的按键检测程序,可控制跑马灯的方向和运行-Based on the DE2-70 development board of four key KEY0- KEY3 test procedures, can control the direction of the entertaining diversions and run
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:420391
    • 提供者:吉泽
  1. LED_seg7

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  2. 基于DE2-70开发板的八个按键7段数码管的检测程序,可控制数码管刷新显示0-f等十六个字符-Based on the DE2-70 development board eight buttons seven segment digital tube detection procedures, can be controlled digital refresh pipe 0 f 16 characters
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:371120
    • 提供者:吉泽
  1. mux16

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  2. 基于DE2-70开发板的十六位乘十六位的乘法器,程序简单易懂-Based on the DE2-70 development board 16 x 16 multiplier, easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:871815
    • 提供者:吉泽
  1. uartverilog

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  2. 基于DE2-70开发板的串口单字节收发数据程序,程序简单易懂,亲测可用-Based on the DE2-70 development board single-byte serial port to send and receive data procedures, procedures simple, test available
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:484998
    • 提供者:吉泽
  1. verilogvga

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  2. 基于DE2-70开发板的VGA接口实现程序,可在VGA屏幕上显示800*600分辨率的图像,刷新频率60Hz-Based on the DE2-70 development board VGA interface implementation procedures, can be displayed on a VGA screen images of the 800* 600 resolution, refresh rate of 60 hz
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7858561
    • 提供者:吉泽
  1. DE2_70_SD_Card_Audio_Player

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  2. DE2-70 SD card player verilog and nios ii code
  3. 所属分类:Other systems

    • 发布日期:2017-05-17
    • 文件大小:4407775
    • 提供者:andy
  1. SD_MEMORY

    0下载:
  2. ex SD controller to DE2-70 altera
  3. 所属分类:software engineering

    • 发布日期:2017-05-30
    • 文件大小:12140790
    • 提供者:kikes
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