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搜索资源 - filter design using fpga
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数字信号处理的fpga实现，用VHDL语言编程实现IIR滤波器,Digital signal processing to achieve the FPGA, using VHDL language programming to achieve IIR filter
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介绍了IIR 滤波器的FPGA 实现方法,给出了 IIR 数字滤波器的时序控制、延时、补码乘法和累加四个模块的设计方法,并用VHDL和FPGA 器件实现了IIR 数字滤波。-Introduction of the IIR filter FPGA implementation method of IIR digital filter timing control, delay, multiplication and accumulation complement the four modules
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:介绍了基于FPGA的FIR数字滤波器的设计与实现,该设计利用Matlab工具箱设计窗函数计算FIR滤波器系数,并通过VHDL层次化设计方法,同时FPGA与单片机有机结合,采用C51及VHDL语言模块化的设计思想及进行优化编程,有效实现了键盘可设置参数及LCD显示。结果表明此实现结构能进一步完善数据的快速处理和有效控制,提高了设计的灵活性、可靠性和功能的可扩展性。
-: This paper presents FPGA-based FIR digital filter design and
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用VHDL语言设计基于FPGA器件的高采样率FIR滤波器,基于VHDL与CPLD器件的FIR数字滤波器的设计-Design using VHDL language FPGA devices based on high sampling rate FIR filter, based on VHDL and CPLD devices, the design of FIR digital filter
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Increasing interest in ultra-wideband (UWB) communications has engendered the need
for a test bed for UWB systems. An FPGA-based software-defined radio provides both postfabrication
definition of the radio and ample parallel processing power. Thi
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自己编写多速率滤波器设计，采用VHDL语言，通过FPGA实现-I have written multi-rate filter design using VHDL language, through the FPGA to achieve
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FIR filter design method using Xilinx FPGA platform.
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In most cases, a bandpass filter characteristic
is obtained by using a lowpass-to-bandpass frequency
transformation on a known lowpass transfer function. This
frequency transformation controls the location of passband
edges and transfer zero
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基于FPGA的高阶FIR滤波器设计4有matlab设计步骤 4.3更详细 第六章量化系数实例-FIR using FPGA ，QuartusII software
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基于FPGA的高阶FIR滤波器设计用max-plus －II软件仿真-fir filter using fpga with max-plusII
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利用FPGA设计降采样滤波器的方法，希望对你有用-FPGA design using down-sampling filter, and I hope useful to you
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利用fpga来设计滤波器 计算速度快，可靠性强！滤波效果很好，值得信赖-Filter design using fpga to calculate the speed, reliability! Filter works well, trustworthy
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fpga无线通信多率滤波器设计-fpga design about multi-rate filter about wireless communication
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利用ISE的IP核在FPGA上设计fir滤波器-Fir filter IP core on FPGA design using the ISE
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基于fpga的抽取CIC滤波器设计,采用verilog编写，24抽取,仿真通过-Fpga-based CIC decimation filter design using verilog written, 24 extraction
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基于fpga的插值CIC滤波器设计,采用verilog编写，24倍插值,仿真通过-Fpga-based interpolation CIC filter design using verilog write, 24x interpolation, through simulation
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采用xilinx进行的FPGA的FIR滤波器设计-Conducted using xilinx FPGA FIR filter design
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这是关于fallow滤波器的设计，设计平台为FPGA，使用verilog语言，希望对使用者能用帮助-This is the fallow filter design, design platform FPGA, using verilog language, and I hope to be able to help users
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利用Altera公司推出的FPGA开发工具DSP Builder，对锁相解调算法中的主要部件：数控振荡器(NCO)、计算反正切的CORDIC模块和FIR低通滤波器进行了单独设计和仿真，最终完成了锁相解调系统的整体设计。-Designed and simulated major components of phase-locking Demodulation Algorithm independently, including: Number Controlled Oscillator(NCO)、
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基于FPGA实现FIR滤波器功能
使用芯片为EP2C8Q208C8N,实现FIR滤波器的设计，使用Verilog语言编程，本例子有工程文件、仿真、波形，经过测试可以使用。-FIR filter function based on FPGA chip to use EP2C8Q208C8N, achieve FIR filter design using Verilog language programming, the present examples are engineering doc
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