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搜索资源列表

  1. interleaver-vhdl.rar

    1下载:
  2. VHDL编写的基于FPGA的4-8交织器代码,有需要的下来看看,4-8 prepared VHDL code interleaver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1446
    • 提供者:cab
  1. FPGA_interleaver

    0下载:
  2. 这是一个基于FPGA的交织器的VHDL源代码-This is an FPGA-based interleaver of the VHDL source code for
  3. 所属分类:Other systems

    • 发布日期:2017-03-29
    • 文件大小:121077
    • 提供者:xx
  1. interweave_1

    0下载:
  2. 用VHDL语言编写的实现交织编码和解交织功能的代码。交织采用按行写入,按列读出的方法实现。主要包括:信源信号产生(20位的m序列),交织器,解交织器。为实现流水线的操作,采用了两个交织器和两个解交织器,当一个写入数据的时候,另一个读出数据。-Implementation using VHDL language features Interleaved Coded deinterleave code. Intertwined with by line write, read out by colu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:37242
    • 提供者:李修函
  1. 4_31

    0下载:
  2. 这是一个交织器/解交织器的FPGA实现,虽然交织器的功能简单,但是其实现比较复杂-This is an interleaver/de-interleaver to achieve the FPGA, although the function of interleaver simple, but its more complicated to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:834348
    • 提供者:谢建伟
  1. interleaver

    0下载:
  2. This is a convolutional interleaver code written in verilog, the ram is sram with ram_ncs, ram_nwe, ram_noe characters.
  3. 所属分类:Other systems

    • 发布日期:2017-03-28
    • 文件大小:1638
    • 提供者:tomsontiger
  1. interleaver

    0下载:
  2. 实现矩阵交织的Veriog源代码,内含有modelsim测试文件-Veriog interwoven matrix of the realization of the source code files containing the test modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:28049
    • 提供者:尚龙
  1. DVB

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  2. DVB系统中交织器和解交织器设计的FPGA实现-DVB system, the reconciliation Interleaver Interleaver design FPGA implementation
  3. 所属分类:Communication

    • 发布日期:2017-03-26
    • 文件大小:708405
    • 提供者:程钢
  1. jiaozhiqi

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  2. 是Turbo码交织器的VHDL设计与仿真的文献-Is the Turbo Code Interleaver Design and Simulation of VHDL literature
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:765667
    • 提供者:郑国
  1. interleaver

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  2. vhdl code for interleaver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:558
    • 提供者:aruna
  1. INTERLEAVER

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  2. 1/3,k=9的卷积码VHDL实现,在xilinx ise上仿真成功。-1/3, k = 9 convolutional code VHDL implementation of the simulation in the xilinx ise success.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1117
    • 提供者:杨胜丰
  1. 15Turbo

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  2. urbo码是1993年法国人Berrou提出的一种新型编码方法。它巧妙的将卷积码和随机交织器结合在一起;同时,采用软输出迭代译码来逼近最大似然译码-urbo code is 1993 French Berrou proposed a new encoding method. It is clever to convolutional codes and random interleaver together the same time, the use of soft-output itera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:62861
    • 提供者:wangzhi
  1. interleaver

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  2. In this case is a interleaving algorithm code for deinterleaving the code, using VHDL language. This code provide the method of interleaving of the convolutioned code
  3. 所属分类:Modem program

    • 发布日期:2017-04-15
    • 文件大小:5638
    • 提供者:kimdaeyoung
  1. interleaver-vhdl-code

    0下载:
  2. lte turbo interleaver
  3. 所属分类:Communication

    • 发布日期:2017-04-25
    • 文件大小:143403
    • 提供者:sampath
  1. VHDL-implementation

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  2. document discribe the way how to implemete an interleaver using VHDL code
  3. 所属分类:Communication

    • 发布日期:2017-12-11
    • 文件大小:7060569
    • 提供者:essedik
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