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  1. complement_adder

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  2. 十六位补码加法器,输入为两个16位补码,输出和为17位补码,不虚溢出标志。-Sixteen complement adder, the input to complement the two 16-bit, output, and for the 17 complement, not virtual overflow flag.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:211451
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