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  1. electronic-clock

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  2. 数字电子钟是数字电路中的一个经典学习内容。我们选用电子钟作为最后结课项目的目的，是为了学习verilog语言、FPGA的基本知识、由顶层至底层的设计思路。-VHDL source code for electronic clock design to share

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2016-12-24
    • 文件大小：252928
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