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  1. USB2.0IP(RTL)

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  2. USB2.0 IP核,ASIC,FPGA可用,Verilog HDL源代码-USB2.0 IP,Verilog HDL

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2014-08-29
    • 文件大小：64776
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