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BCD2
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- 这是一个测量频率得程序文档,测量精度高,可测范围宽
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数字滤波器的FPGA实现
- 数字滤波器的FPGA实现,verilogHDL-Digital Filter FPGA, verilogHDL
VGA图像显示
- 该项目能将RAM或ROM存储器中储存的十六进制数据显示在VGA显示器上,使用VerilogHDL]语言,在Altera的QuartusII下编译通过。
micron nand flash simulation model
- If you want to code a nand flash controller, you must be need a simulation model of a existing nand flash. This appedix is your wanted. It is a verilogHDL code.
fpga与PC机的串口通信
- 基于VerilogHDL 的FPGA与PC的串口通信代码,已经测试过,绝对可以用
71V416_Verilog_95461.rar
- SRAM IDT71V416的VerilogHDL仿真模型源码文件,SRAM IDT71V416 simulation model of the source document VerilogHDL
vga_moving_pixel.rar
- 该项目在VGA显示器上显示一个移动的光点,并且光点的颜色还可以改变。使用VerilogHDL 语言编写,在Altera公司的QuartusII开发环境下验证通过。,The project in the VGA display to show a moving spot, and spot colors can be changed also. VerilogHDL language used in Altera' s development environment QuartusII ve
Verilog.rar
- 《设计与验证VerilogHDL》源码实例 和 Verilog规范,not~
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- 一个基于VerilogHDL语言的16位的booth算法的乘法器及其测试代码,VerilogHDL language based on the 16-bit multiplier of the booth algorithm and test code
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- verilogHDL编写的QPSK选相法调制模块,在ISE软件中仿真过,可综合,绝对是正确的,verilogHDL preparation phase of the QPSK modulation selection module, in the ISE simulation software that can be integrated, is absolutely correct
lab.rar
- verilog hdl经典例程,全部调试通过,verilogHdl example,all can be used
verilogHDL.rar
- 采用有限状态机(要求“三段式”)的方法设计一个带异步清零端的同步可逆模6计数器。同时提供单数码管数字显示和3LED状态显示两种显示方式。,Finite state machine (request, quot Threequot) approach to design a client with Asynchronous Clear reversible synchronous counter module 6. At the same time providing a single digit
SRAM
- VerilogHDL语言读写SRAM内部数据。SRAM芯片型号为61WV102416ALL,即1024K字,每字16位,共16Mb。工作在100MHz频率下。-VerilogHDL language to read and write internal data SRAM. SRAM chip model 61WV102416ALL, ie 1024K words, each word 16, a total of 16Mb. Work in the 100MHz frequency.
Chapter10
- 第十章的代码。 本书通过100多个模块实例,详细地讲解了Verilog HDL程序设计语言,全书共分13章,内容涉及VerilogHDL语言基本概念、建模、同步设计、异步设计、功能验证等,实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、SPIMaster Controller、I2C Master controller、CAN ProtocolController、Memory模块、JPEG图像压缩模块、加密模块、ATA控制器、8位RISC-CPU等及各个实例模块相
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- FPGA开发板上的VerilogHDL编写的SRAM读写试验程序, 包括介绍文档, Verilog源码, 在Quartus II 8.1环境下测试通过-FPGA development board SRAM VerilogHDL prepared to read and write test procedures, including the descr iption document, Verilog source code, the Quartus II 8.1 environment te
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- 基于verilogHDL语言的8b10通信变换。-verilog 8b10b