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  1. exp3

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  2. 花样流水灯:8个发光二极管D1~D8分别接在单片机P0.0-P0.7端口上,一个开关接在P3.0上。要求输出端口输出“0”时,发光二极管亮。开关闭合时,开始按P0.0+P0.7、P0.1+P0.6、P0.2+P0.5、P0.3+P0.4的顺序依次点亮LED,再按P0.3+P0.4、P0.2+P0.5、P0.1+P0.6、P0.0+P0.7的顺序点亮LED,重复循环。开关断开时,立刻停止点亮指示灯。-Mood Light water: 8 LEDs D1 ~ D8, respectively, c
  3. 所属分类:SCM

    • 发布日期:2017-04-06
    • 文件大小:806byte
    • 提供者:张志
  1. SDCardProjectwithPic

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  2. SD Card Project with PIC
  3. 所属分类:SCM

    • 发布日期:2017-05-23
    • 文件大小:7.29mb
    • 提供者:segantin
  1. PWM_Module

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  2. Very clean design of a PWM module made in structural VHDL. Lower blocks are behavioral.Designed in Quartus 9.0,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.63mb
    • 提供者:nada
  1. filtro_hdlcoder

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  2. Example project of a filter designed in MATLAB and exported to VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.06mb
    • 提供者:nada
  1. Dip_PB_LED

    0下载:
  2. 4 bit counter. 1 Push Button (PB) and 1 Dip Switch (DP)are inputs. 4 Leds (common anode) are outputs.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.5kb
    • 提供者:nada
  1. ADC

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  2. analog to digital converson programmed in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:463.59kb
    • 提供者:JT_LADINO
  1. rs232_receive_control

    0下载:
  2. RS232 receive control in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.17kb
    • 提供者:JT_LADINO
  1. rs232_receiver

    0下载:
  2. receiver RS-232 programmed in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.87kb
    • 提供者:JT_LADINO
  1. rs232_transmitter

    0下载:
  2. tranmitter RS232 programmed in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.57kb
    • 提供者:JT_LADINO
  1. host_common

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  2. function for host common
  3. 所属分类:Embeded Linux

    • 发布日期:2017-03-31
    • 文件大小:30.96kb
    • 提供者:Jinzz
  1. CtrlClient

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  2. STC89C51驱动L298并接受串口通讯(协议)KEIL C程序-STC89C51 drive L298, and accept the serial communication (protocol)
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:23.42kb
    • 提供者:muyi
  1. epcverilogTimer

    0下载:
  2. 用verilog编写的epc的仿真定时器。用quartus2 仿真-Epc prepared with verilog simulation timer. Simulation with quartus2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:43.16kb
    • 提供者:weiyi
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