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  1. 移位寄存器

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  2. First in first out寄存器的verilog源代码

  3. 所属分类：VHDL编程

    • 发布日期：2009-02-22
    • 文件大小：1.14kb
    • 提供者：sh0205

  1. 电梯控制器程序设计与仿真

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  2. 电梯控制器程序设计与仿真,已经通过仿真．

  3. 所属分类：VHDL编程

    • 发布日期：2009-02-24
    • 文件大小：158.71kb
    • 提供者：zhangjie5168

  1. 100Examples

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  2. 100个VHDL语言示例源代码

  3. 所属分类：VHDL编程

    • 发布日期：2009-03-06
    • 文件大小：203.71kb
    • 提供者：baoyatu

  1. 密勒解码器

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  2. 本题的程序参考了 wangliwei同学的设计文档，在此非常感谢他给我学习的机会。好在我自己是抱着学习的态度来参加这次大赛的，所以也不至于说成抄袭:(. 本文在理解wangliwei同学程序的基础上，改写了“检测模块”，重新编写了“解码模块”以及三个测试程序。所以这次虽然交的很晚，但总算是我自己理解的成果，我学到了知识，这就够了。 关于本次程序的一点理解： (1) 由于给定时钟不完整，“检测模块”中大量使用了“事件触发”，这对综合后的结果肯定会有很大影响，并且不符合同

  3. 所属分类：VHDL编程

  1. 8bit全加器带进位复位功能

    0下载：
  2. 8bit全加器带进位复位功能 已经通过防真

  3. 所属分类：VHDL编程

  1. 5分频、移相VHDL程序

    0下载：
  2. 有两端VHDL程序，5分频的和分频移相的，希望大家用的上

  3. 所属分类：VHDL编程

  1. FFT的FPGA实现

    0下载：
  2. 快速傅里叶变换的FPGA实现

  3. 所属分类：VHDL编程

  1. SDRAM控制核

    0下载：
  2. SDRAM控制核SDRAM控制核

  3. 所属分类：VHDL编程

    • 发布日期：2009-03-26
    • 文件大小：98.49kb
    • 提供者：sunrainhh

  1. 基于CPLD的VHDL语言数字钟（含秒表）设计

    0下载：
  2. 基于CPLD的VHDL语言数字钟（含秒表）设计

  3. 所属分类：VHDL编程

  1. 多功能波形发生器VHDL程序与仿真

    0下载：
  2. 非常实用的一款软件,多功能波形发生器VHDL程序与仿真

  3. 所属分类：VHDL编程

    • 发布日期：2009-04-03
    • 文件大小：60.5kb
    • 提供者：yuan0425

  1. 汉明纠错码译码器源程序

    0下载：
  2. 汉明纠错码译码器的VHDL源程序

  3. 所属分类：VHDL编程

    • 发布日期：2009-04-03
    • 文件大小：3.26kb
    • 提供者：yxpsc@tom.com

  1. 基于VHDL 语言的AöD 采样控制器设计

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  3. 所属分类：VHDL编程

    • 发布日期：2009-04-04
    • 文件大小：250.08kb
    • 提供者：ljs183
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