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  1. clk_div

    0下载：
  2. VERILOG实现多时钟,可以应用于流水线.输入CLK,输出CLK1,CLK2,CLK3

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1.36kb
    • 提供者：kaimen

  1. ps2_verilog

    0下载：
  2. ps2_键盘控制器源码verilog源码，是一个不错的代码

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：13.21kb
    • 提供者：高鹏

  1. gal16v8

    0下载：
  2. 这是一个开发gal16v8器件的详细源代码，对开发16v8可编程逻辑器件有很高的参考价值

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：33.59kb
    • 提供者：杨俊营

  1. code

    0下载：
  2. CPLD驱动VGA显示器的VERILOG源代码．

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：231.61kb
    • 提供者：xuhong

  1. lctl_1.2

    0下载：
  2. CPLD的例子程序1,EPM7128芯片,ISA总线

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：212.01kb
    • 提供者：Sean Cheung

  1. v2.1_ok

    0下载：
  2. CPLD的例子程序2,EPM7064芯片,PC104扩展卡上应用

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：254.17kb
    • 提供者：Sean Cheung

  1. toshiba

    0下载：
  2. TOSHIBA公司的射频卡VERILOGHDL代码 包括TOP 顶层文件，MAIN主要控制文件，EEPROM存储单元文件

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：8.2mb
    • 提供者：liangtao

  1. tx

    0下载：
  2. 自己编写的串口UART发送的Verilog模块。与FIFO连接，可以实现自动连续发送。

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：7.15kb
    • 提供者：YongZhiLi

  1. rxd

    0下载：
  2. 自己编写的串口UART的接收Verilog模块，支持中断和查询方式接收，对信号的畸变适应能力强。

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1.77kb
    • 提供者：YongZhiLi

  1. ram

    0下载：
  2. RAM， Random-access memory，Verilog code

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：14.4kb
    • 提供者：leigh lee

  1. rom

    0下载：
  2. Read-only memory,Verilog code

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：8.04kb
    • 提供者：leigh lee

  1. 128×16ram

    0下载：
  2. VHDL程序设计的RAM存储器，双端口，128×16比特

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：863byte
    • 提供者：petri
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