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  1. I2C-in-CPLD

    0下载:
  2. I2C在CPLD上的模拟实现源程序,用C语言编写而成-I2C CPLD in the simulation source code, C language prepared! !
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:1.03kb
    • 提供者:于向鹤
  1. RAMtestbench

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  2. 双口Ram的VHDL Testbench-Dual-Port Ram s VHDL Testbench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.03kb
    • 提供者:赵国栋
  1. 2

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  2. ad转换程序,所使用的单片机为MPS430,8通道,采样AD通道的电压,并将其度出来显示-ad conversion process, the use of single-chip for MPS430, 8-channel, voltage-channel AD sampling and display degrees out
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-05
    • 文件大小:1.03kb
    • 提供者:刘厚荣
  1. nby4mul2

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  2. n/4 pipeline multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.03kb
    • 提供者:sakthivel.p
  1. cnt10.vhd

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  2. 设计一个10进制同步计数器,带一个清零端,一个进位输出端。(如果改成六进制,应该如何修改程序) 计数器分为同步计数器和异步计数器两种,是典型的时序电路,分析计数器就能更好的了解时序电路的特性。所谓同步计数器,就是在时钟脉冲的控制下,构成计数器的各触发器同时发生变化的那一类计数器。异步计数器又称行波计数器,它的下一位计数器的输出作为上一位计数器的时钟信号,这样一级一级串接起来就构成了一个异步计数器。异步计数器与同步计数器不同之处就在于时钟脉冲的提供方式,但是,由于异步计数器采用行波计数,从
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:1.03kb
    • 提供者:chenguoxian
  1. 8b-TO-10b-Encoder

    0下载:
  2. Encoder to create TLP s for data trasmission.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.03kb
    • 提供者:Nikhil
  1. LCD1602

    0下载:
  2. 通过标准程序静态显示2行字符,适用于单片机的c程序 -Static display by standard procedures 2 line character, c program for the microcontroller
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-10
    • 文件大小:1.03kb
    • 提供者:
  1. 6

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  2. 该程序包含了完整的实体结构,实现的是一个K位xK位的布斯乘法器-The program includes a complete physical structure, to achieve a K xK-bit Booth multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.03kb
    • 提供者:
  1. pc_com

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  2. 单片机实验程序,EXP7_51和PC通信实验,代码完整-SCM experimental procedures, EXP7_51 and PC communication experiment, complete code
  3. 所属分类:Other Embeded program

    • 发布日期:2017-12-05
    • 文件大小:1.03kb
    • 提供者:lwq
  1. key_smiao

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  2. vhdl语言编写的矩阵键盘采集程序,调试通过-the matrix keyboard VHDL language acquisition program, debug through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:1.03kb
    • 提供者:lh
  1. mux4_1

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  2. 4對1得多工器,使用verilog與法寫成,包含test檔案-4to1 mux
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.03kb
    • 提供者:蘇柏睿
  1. DS1302

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  2. 基于51单片机ds1302始终串口自动更新时间程序-Based on 51 single-chip serial ds1302 always automatically update the time program
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-12
    • 文件大小:1.03kb
    • 提供者:jack
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