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  1. ds1302C

    0下载:
  2. 芯片ds1302的驱动和应用,可以直接调用。并且配有说明和解释
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2014-01-17
    • 文件大小:856byte
    • 提供者:黄小用
  1. counter

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  2. 计数器的VHDL设计,已经在FPGA上验证
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:856byte
    • 提供者:chen
  1. test_in

    0下载:
  2. 用Verilog编写的产生图像的程序,实现24位数据量产生图像使用DA转换后直接显示-Verilog prepared using the procedure for selecting the images to achieve 24-bit image data generated using the DA converter and directly show the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:856byte
    • 提供者:lvxingli
  1. pcm

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  2.   在光纤通信系统中,光纤中传输的是二进制光脉冲"0"码和"1"码,它由二进制数字信号对光源进行通断调制而产生。而数字信号是对连续变化的模拟信号进行抽样、量化和编码产生的,称为PCM(pulse code modulation),即脉冲编码调制。这种电的数字信号称为数字基带信号,由PCM电端机产生。-In optical fiber communication systems, fiber-optic transmission of light pulses is a binary "
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:856byte
    • 提供者:圈石
  1. 1

    0下载:
  2. 实现按键中断,在NIOS II IDE平台上实现按键中断,按键驱动程序在Quartus ii里面用VHDL编写。-interrupt
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:856byte
    • 提供者:stone
  1. conv_enc

    0下载:
  2. 卷积码编码,用veriolog实现一个(2,1,3)卷积编码-Convolutional coding, with veriolog implement a (2,1,3) convolutional code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:856byte
    • 提供者:瑶云城
  1. spi

    0下载:
  2. 描述了总线的vhdl程序,并且有测试语句的描写 仿真之后可以实现-Describes the bus vhdl program, and a test statement, after describing the simulation can be achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:856byte
    • 提供者:王韩
  1. boot.c

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  2. TMS320F2812ADSP 芯片烧写实验-TMS320F2812ADSP chip burning experiment
  3. 所属分类:DSP program

    • 发布日期:2017-04-11
    • 文件大小:856byte
    • 提供者:www
  1. fir2

    0下载:
  2. 基于dsp的滤波器设计已在matlab ccs上调试成功-Dsp-based filter design in Matlab ccs successful commissioning
  3. 所属分类:DSP program

    • 发布日期:2017-03-30
    • 文件大小:856byte
    • 提供者:邱叶
  1. AD_4-

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  2. ADC,芯片AD7812的转换代码,可实现AD转化,AD芯片用的是AD7812,实现16位数模转化-Verilog HDL code, the AD conversion can be achieved. AD-chip using a AD7812
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:856byte
    • 提供者:管鑫
  1. 1324-f4rt

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  2. The VHDL code presented in this model will enable you to see how to create behavioural ADC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:856byte
    • 提供者:jsoe
  1. multiplier32

    0下载:
  2. 32 BIT MULTIPLICATION VHDL CODE IMPLEMENTED IN XILINX
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:856byte
    • 提供者:annie
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