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  1. CoG

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  2. Semi-functional FSM and ROM for Xilinx CPLD to drive ST7565R based off Digikey example
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.02mb
    • 提供者:Mac
  1. Infrared-Control

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  2. PIC红外控制资料 希望对大家有用-PIC IR control information useful to all of us hope
  3. 所属分类:SCM

    • 发布日期:2017-04-09
    • 文件大小:1.02mb
    • 提供者:limumu
  1. LMS-Computer-Exercises

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  2. LMS 用一个二阶FIR的LMS自适应滤波器消除正弦干扰的一个方案。-LMS using a second-order FIR LMS adaptive filter to eliminate a program sinusoidal interference.
  3. 所属分类:DSP program

    • 发布日期:2017-05-06
    • 文件大小:1.02mb
    • 提供者:liang
  1. MCS_51andSRAM

    0下载:
  2. 描述了单片机外扩RAM的设计方案和连接图-Describes the single-chip RAM expansion outside of the design and connection diagram
  3. 所属分类:SCM

    • 发布日期:2017-05-06
    • 文件大小:1.02mb
    • 提供者:wuhuwei
  1. v120

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  2. dsptms320f2812的例程源代码包含,头文件,源文件,链接文件,库文件-dsptms320f2812 routines source code contains header files, source files, link files, libraries
  3. 所属分类:DSP program

    • 发布日期:2017-05-06
    • 文件大小:1.02mb
    • 提供者:杨军
  1. HVBLDC_Sensored

    1下载:
  2. 高压直流无刷电机控制,含速度传感器,控制器为TI公司的F28035(HVBLDC Control, Sensored, TI, F28035)
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2017-12-28
    • 文件大小:1.02mb
    • 提供者:ccrr
  1. Timer

    0下载:
  2. 创建一个程序,通过菜单来控制创建定时器,销毁计时器。-Create a program, create a timer to control the menu, destroy the timer.
  3. 所属分类:SCM

    • 发布日期:2017-05-06
    • 文件大小:1.02mb
    • 提供者:陈春丽
  1. STM32F107datasheet_all

    0下载:
  2. STM32f105、107官方数据手册,比较权威,无删减。-STM32f105,107 official data sheet, more authoritative, no deletion
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-07
    • 文件大小:1.02mb
    • 提供者:范睿
  1. nand

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  2. DSP program nand examples
  3. 所属分类:DSP program

    • 发布日期:2017-05-07
    • 文件大小:1.02mb
    • 提供者:cwlee
  1. MB_Labs

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  2. example VHDL for spartan e3
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.02mb
    • 提供者:Hang
  1. extension_pack_latest.tar

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  2. This project contains files you can use to expand upon the basic IEEE packages you normally use for creating testbenches and RTL code. Automatic count stop/start value generation functions. You enter a time duration and clock frequency and the v
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:1.02mb
    • 提供者:Louis
  1. extension_pack_latest.tar

    0下载:
  2. This project contains files you can use to expand upon the basic IEEE packages you normally use for creating testbenches and RTL code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.02mb
    • 提供者:mahmoud
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