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  1. stm8_gpio_touchkey

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  2. 使用STM8S GPIO实现的 多个电容触摸按键,实测效果良好,希望能给有需要的朋友提供帮助,谢谢。-STM8S GPIO implemented using a plurality of capacitive touch buttons, the measured result is good, I hope to give a friend needs help, thank you.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-13
    • 文件大小:1.89kb
    • 提供者:孙将军
  1. vga_lcd_latest.tar

    0下载:
  2. 该OpenCores的增强VGA/ LCD 控制器核心提供了VGA 能力的嵌入式系统。它 同时支持CRT和LCD显示器 与用户可编程的分辨率 和视频定时,从而提供了 几乎所有可用的兼容性 LCD和CRT显示器。-The OpenCores Enhanced VGA/LCD Controller Core provides VGA capabilities for embedded systems. It supports both CRT and LCD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.71mb
    • 提供者:刘磊
  1. modbus_latest.tar

    0下载:
  2. modbus的fpga实现。opencores上最新版本。使用fpga实现,可以大大提高响应速度,对其功能进行模块化。-modbus of fpga implementation. opencores the latest version. Use fpga implementation, can greatly improve the response speed, its function modularity.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:26.25kb
    • 提供者:刘磊
  1. hc595

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  2. This source code implement led module using 74HC595
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.7kb
    • 提供者:Quan
  1. danpianji

    0下载:
  2. 计是利用MCS-51单片机内部的定时/计数器、中断系统、以及行列键盘和LED显示器等部件,设计一个单片机电子时钟。设计的电子时钟通过数码管显示,并能通过按键实现设置时间和暂停、启动控制等。-Meter is the use of MCS-51 microcontroller internal timer/counter, interrupt system, and the ranks of the keyboard and LED displays and other components,
  3. 所属分类:SCM

    • 发布日期:2017-04-30
    • 文件大小:29.86kb
    • 提供者:
  1. Xilinx_verilog

    0下载:
  2. 这是Xilinx公司公布的对于大学生的FPGA教程,由浅入深,非常适合初学者-This is Xilinx company released for FPGA tutorial college students, it is very suitable for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.31mb
    • 提供者:吴超
  1. 比赛程序

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  2. 2012年大学时参加比赛的程序,用的是MDK开发环境,带ucos系统的
  3. 所属分类:uCOS开发

  1. part5

    0下载:
  2. part 5 lab 2 vhdl altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.27kb
    • 提供者:minh
  1. part4

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  2. part 4 lab 2 vhdl altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7kb
    • 提供者:minh
  1. part3

    0下载:
  2. part 3 lab 2 vhdl altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:4.68kb
    • 提供者:minh
  1. part1

    0下载:
  2. part1 lab2 vhdl altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.19kb
    • 提供者:minh
  1. Part-2

    0下载:
  2. part structure for lab 2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.77kb
    • 提供者:minh
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