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  1. TestUSB

    0下载：
  2. fpga之ep1 c6的usb实验源码,经实验验证好好用,大家可以试试看哦

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：153.8kb
    • 提供者：liuheng

  1. DctInH264

    0下载：
  2. 这个是华清远见 高级班 培训的 实验 代码(vhdl)

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：2.28kb
    • 提供者：陈晓

  1. OnChipRam

    0下载：
  2. 这个是华清远见 高级班 培训的 实验 代码

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：173.06kb
    • 提供者：陈晓

  1. SRAM

    0下载：
  2. 这个是华清远见 高级班 培训的 实验 代码

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：2.1kb
    • 提供者：陈晓

  1. SmartSOPC_standard_1c6

    0下载：
  2. 这个是华清远见 高级班 培训的 实验 代码

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：834.04kb
    • 提供者：陈晓

  1. SmartSOPC_standard_1c12

    0下载：
  2. 华清远见 高级的培训 实验代码

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：835.91kb
    • 提供者：陈晓

  1. vcvhdl

    0下载：
  2. 两路电机CPLD控制,串口通信，兼遥控PIN信号输入，强制停止。

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：505.75kb
    • 提供者：hxf

  1. modelsim

    0下载：
  2. 数字IC设计人员刚起步时几乎都是从modelsim开始的，它的重要性不言而喻

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1.07mb
    • 提供者：楚天

  1. DCT_1D

    0下载：
  2. 一维DCT变换的verilog源码，可用于JPEG算法优化的参考。程序中用到的算法称为“扭卷积”，可参考相关IEEE paper

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：53.18kb
    • 提供者：楚天

  1. (Modelsim)simulation

    0下载：
  2. 这是关于VHDL编程仿真的东西,大家感兴趣的话可以下载.原文并不是这个名字,里边有三个文件.

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：66.62kb
    • 提供者：madder

  1. Mentor(Modelsim)

    0下载：
  2. 原言语名字是MODELSIM百问.是一些常见的使用过程中出现的问题.希望对大家有用处.谢谢.

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：761.45kb
    • 提供者：madder

  1. vspi

    0下载：
  2. verilog VSIP core,用verilog语言编写，希望对各位朋友有所帮助！

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：13.11kb
    • 提供者：liuzinan
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