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  1. DCT

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  2. Discrete Cosign Transform(DCT) Verilog Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.65kb
    • 提供者:scpark
  1. JPEG

    0下载:
  2. JPEG Encoder Verilog Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-06-15
    • 文件大小:11kb
    • 提供者:scpark
  1. random_num_gen

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  2. Combination is formed by permuting and XORing 32 bits of LFSR and CASR
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.75mb
    • 提供者:ad
  1. vender1

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  2. Vending Machine Controller Verilog Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.35kb
    • 提供者:scpark
  1. DDR2_Control

    0下载:
  2. 本文档以Siga-S16 Spartan 6的FPGA开发板为例,为大家介绍用MIG工具生成DDR2控制器,并用ChipScope调试DDR2读写的方法。 -This document in the FPGA development board Siga-S16 Spartan 6 as an example, to introduce the formation of DDR2 controller with the MIG tool, and use the debug method of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.35mb
    • 提供者:ad
  1. hello_audio

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  2. 通过本篇,您可以了解到MicorBlaze系统通过I2C接口控制语音芯片WM8731的方法及通 过I2S的接口和WM8731的数据通信实现录音和播放的功能。-Through this article, you can realize the control of MicorBlaze system voice chip WM8731 through the I2C interface and realized through I2S data communication interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:87.5kb
    • 提供者:ad
  1. DES

    0下载:
  2. Data Encryption Standard(DES) VHDL Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7.55kb
    • 提供者:scpark
  1. vga

    0下载:
  2. VGA graphic controller Verilog Source Code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.27kb
    • 提供者:scpark
  1. uart_Verilog

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  2. uart接口verilog源码,实现数据串并行的转换。内容包含十个代码文件。-uart Interface verilog source of data for serial-parallel conversion. Contains ten code files.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:10.07kb
    • 提供者:裴根
  1. UART verilog代码

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  2. UART verilog代码,基于时间单位为1ns,精度为100ps的UART代码
  3. 所属分类:VHDL编程

  1. SPI-masterslave

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  2. SIP-serial peripheral interface one type of serial communication bus protocol for network environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:43.09kb
    • 提供者:manasa chimmani
  1. Stamp-vending-machines

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  2. 设投币初始状态为ST0,如果投入一枚五毛硬币为ST1, 如果投入两枚五毛或者投入一枚一元硬币(累计一元)为ST2,如果投入三枚五毛或者一枚五毛和一枚一元(累计一元五角)为ST3,如果投入四枚五毛或者两枚五毛和一枚一元或者两枚一元(累计两元)为ST4,在ST4状态下,如果再次投入一枚五毛硬币,则输出邮票并返回初始状态,如果再次投入一枚一元硬币,则输出邮票并找回五毛同时返回初始状态。-Stamp vending machines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:3.91kb
    • 提供者:zhangpei
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