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  1. 74HammingCode

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  2. 用VHDL语言编写的可以实现(7,4)汉明码编解码的程序。-Using VHDL language can be achieved (7,4) Hamming Code Codec procedures.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:661.58kb
    • 提供者:王磊
  1. FPGA

    0下载:
  2. FPGA入门,介绍的还不错,与大家分享了-FPGA Starter introduce also good to share with you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-11
    • 文件大小:577.81kb
    • 提供者:刘大贺
  1. vhdl_cnt_16

    0下载:
  2. 可预置16位计数器 可预置16位计数器-vhdl_16bit_counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:972byte
    • 提供者:方先生
  1. frequence_div

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  2. 三分频程序,对输入的时钟信号进行分频,在此基础上可以进行倍频和分频的转化。-frequence divice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.08kb
    • 提供者:jeff
  1. vga

    0下载:
  2. VGA wrapper written in VHDL. This wrapper can be used to send VGA signals to the FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:5kb
    • 提供者:Rohit Kumar
  1. 2ddct

    0下载:
  2. 这是一款比较好的关于可编程逻辑器件的状态机源代码-This is a good comparison about programmable logic device of the state machine source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-06-14
    • 文件大小:814.41kb
    • 提供者:jyb
  1. frequency

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  2. 一种等精度的频率计,同时适合高频和低频,误差小。-A precision frequency meter, etc. At the same time, suitable high-frequency and low frequency, the error small.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.21kb
    • 提供者:邹国雄
  1. poc

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  2. 用VHDL语言讲述输出控制器(POC)的设计,这是大学课程的设计-VHDL language used on the output controller (POC) design, This is the design of university courses
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:32.69kb
    • 提供者:黄小芳
  1. b

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  2. 毕业设计中的12层电梯信号的控制程序VHDL-Graduation Design 12-storey elevator signal control procedures VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:527byte
    • 提供者:王恒
  1. altera_avalon_uart_init

    0下载:
  2. 用v-hdl写的基于fpga的串口驱动程序希望对大家有帮助-With v-hdl Writing FPGA-based serial driver would like to have everyone help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:5.18kb
    • 提供者:滕骞
  1. cnt

    0下载:
  2. 对输入时钟做除以8的分频和除以4的分频功能-Does the input clock frequency divided by 8 and divided by the number of sub-4 sub-frequency function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:115.33kb
    • 提供者:chujiang
  1. VHDL_1602

    0下载:
  2. 显示LCD,采用VHDL语言编写,基于1602的显示模块-Display LCD, using VHDL language, based on the 1602 display module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.52mb
    • 提供者:lk
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