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  1. clock

    0下载：
  2. 利用xilin实验仪完成一个可以计时的数字时钟，显示范围位00.00～59.59，且该时钟应该具有暂停计时，清零灯功能。

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：78.55kb
    • 提供者：haolj

  1. pwm1

    0下载：
  2. xilinx设计并完成一个10位的D/F转换器，输入的数字量分别由按键K1,K2来调节，其中K1完成加1功能，而K2则完成减1功能，并把转换的结构西哦女冠到BUZZ蜂鸣器上。

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：77.59kb
    • 提供者：haolj

  1. buzz

    0下载：
  2. 利用xilinx实现一个简易的电子琴。简谱中的音名与频率一一对应。

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：123.41kb
    • 提供者：haolj

  1. VHDLserial

    0下载：
  2. UART参考设计带缓存用于Xinlix用于FPGA

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：272.54kb
    • 提供者：sd

  1. SDcardcode

    0下载：
  2. 基于c语言上的SD卡读写源程序，希望对大家有所帮助~

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：19.55kb
    • 提供者：王一木

  1. Lab1-INTRO

    0下载：
  2. vcs tutorial lab1，very good

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：5.75kb
    • 提供者：王一木

  1. Lab2-PLI

    0下载：
  2. vcs tutorial Lab2-PLI verygood

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：3.54kb
    • 提供者：王一木

  1. jishiqi

    0下载：
  2. 用verilog实现的记时器程序,在Quartus II上编译通过并成功运行

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：2.12mb
    • 提供者：张兵

  1. qiangdaqi

    0下载：
  2. 用verilog实现的抢答器程序,在Quartus II上编译通过并成功运行

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：185.86kb
    • 提供者：张兵

  1. LED

    0下载：
  2. 数字时钟显示模块,用VERILOG HDL 实现

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：10.87kb
    • 提供者：liufanyu

  1. CANSHUHUA

    0下载：
  2. Verilog参数化的课件,有兴趣的可以来看下

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：10.78kb
    • 提供者：liufanyu

  1. VerilogHDL_clock

    0下载：
  2. 基于Verilog HDL设计的多功能数字钟，有兴趣的

  3. 所属分类：VHDL编程

    • 发布日期：2014-01-17
    • 文件大小：38.29kb
    • 提供者：沈三思
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