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文件名称:finalcoursework

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Windows] [程序]
  • 上传时间：
    2012-11-16
  • 文件大小：
    41.83kb
  • 已下载：
    0次
  • 提 供 者：
    三***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用VHDL代码写的模拟微处理器核程序，有计算模块和register file 等模块，并包含测试程序，调试程序 ACTIVE HDL-Simulation with the VHDL code is written in the microprocessor core procedures, such as computing modules, and register file module, and includes test program, the debugger ACTIVE HDL
相关搜索： register file VHDL 微处理器 active hdl

(系统自动生成,下载前可以参看下载内容)

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finalcoursework/finalcoursework.aws
finalcoursework/finalcoursework.wsw
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finalcoursework/finalcoursework/1finalcoursework.mgf
finalcoursework/finalcoursework/3finalcoursework.mgf
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finalcoursework/finalcoursework/compile.cfg
finalcoursework/finalcoursework/compile/contents.lib~finalcoursework
finalcoursework/finalcoursework/compile/finalcoursework.cmd
finalcoursework/finalcoursework/compile/finalcoursework.epr
finalcoursework/finalcoursework/compile/finalcoursework.erf
finalcoursework/finalcoursework/compile/sources.sth
finalcoursework/finalcoursework/Edfmap.ini
finalcoursework/finalcoursework/elaboration.log
finalcoursework/finalcoursework/finalcoursework.adf
finalcoursework/finalcoursework/finalcoursework.LIB
finalcoursework/finalcoursework/finalcoursework.wsp
finalcoursework/finalcoursework/log/
finalcoursework/finalcoursework/log/console.log
finalcoursework/finalcoursework/projlib.cfg
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finalcoursework/finalcoursework/slp/logs/
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finalcoursework/finalcoursework/src/alu.vhd
finalcoursework/finalcoursework/src/buffer.vhd
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finalcoursework/finalcoursework/synthesis.order
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