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文件名称:fpga2

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    660.56kb
  • 已下载：
    0次
  • 提 供 者：
    xiongju*******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

自己学习fpga时候写的小的测试程序。新入门的人可以看看，研究研究。前面部分有fpga1，后续有fpga3，以及个人心得。-When learning to write their own fpga small test program. People can see the new entry, studies. The front part of a fpga1, follow-up has fpga3, and personal experience.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

fpga2/test5/test5.qpf
fpga2/test5/test5.qsf
fpga2/test5/test5.vhd
fpga2/test5/test5.map.summary
fpga2/test5/test5.map.rpt
fpga2/test5/test5.flow.rpt
fpga2/test5/test5.done
fpga2/test5/test5.vwf
fpga2/test5/test5.sim.rpt
fpga2/test5/test5.qws
fpga2/test5/db/test5.db_info
fpga2/test5/db/test5.map.qmsg
fpga2/test5/db/test5.cbx.xml
fpga2/test5/db/test5.hif
fpga2/test5/db/test5.(0).cnf.cdb
fpga2/test5/db/test5.(0).cnf.hdb
fpga2/test5/db/test5.hier_info
fpga2/test5/db/test5.rtlv_sg.cdb
fpga2/test5/db/test5.rtlv.hdb
fpga2/test5/db/test5.rtlv_sg_swap.cdb
fpga2/test5/db/test5.pre_map.hdb
fpga2/test5/db/test5.pre_map.cdb
fpga2/test5/db/test5.psp
fpga2/test5/db/test5.dbp
fpga2/test5/db/test5.pss
fpga2/test5/db/test5.map_bb.logdb
fpga2/test5/db/test5.sgdiff.cdb
fpga2/test5/db/test5.sgdiff.hdb
fpga2/test5/db/test5.syn_hier_info
fpga2/test5/db/test5.map_bb.cdb
fpga2/test5/db/test5.map_bb.hdb
fpga2/test5/db/test5.map.ecobp
fpga2/test5/db/test5.map.cdb
fpga2/test5/db/test5.map.hdb
fpga2/test5/db/test5.map.logdb
fpga2/test5/db/test5.map.bpm
fpga2/test5/db/test5.cmp.rdb
fpga2/test5/db/test5.tis_db_list.ddb
fpga2/test5/db/test5.fnsim.qmsg
fpga2/test5/db/mux_cfc.tdf
fpga2/test5/db/test5.fnsim.cdb
fpga2/test5/db/test5.fnsim.hdb
fpga2/test5/db/test5.sld_design_entry_dsc.sci
fpga2/test5/db/prev_cmp_test5.qmsg
fpga2/test5/db/test5.sim.qmsg
fpga2/test5/db/test5.sim.hdb
fpga2/test5/db/test5.simfam
fpga2/test5/db/test5.eds_overflow
fpga2/test5/db/test5.sim.cvwf
fpga2/test5/db/test5.sim.rdb
fpga2/test5/db/test5.sld_design_entry.sci
fpga2/test5/db/wed.wsf
fpga2/test5/db/test5.eco.cdb
fpga2/test1/test1.qpf
fpga2/test1/test1.qsf
fpga2/test1/test1.map.summary
fpga2/test1/test1.pin
fpga2/test1/test1.fit.smsg
fpga2/test1/test1.fit.summary
fpga2/test1/test1.tan.summary
fpga2/test1/test1.done
fpga2/test1/test1.dpf
fpga2/test1/test1.vwf
fpga2/test1/test1.fit.rpt
fpga2/test1/test1.asm.rpt
fpga2/test1/test1.tan.rpt
fpga2/test1/Waveform1.vwf
fpga2/test1/test1.vhd.bak
fpga2/test1/test1.vhd
fpga2/test1/test1.map.rpt
fpga2/test1/test1.flow.rpt
fpga2/test1/test1.sim.rpt
fpga2/test1/test1.qws
fpga2/test1/db/mux_cfc.tdf
fpga2/test1/db/test1.db_info
fpga2/test1/db/test1.map_bb.logdb
fpga2/test1/db/test1.sgdiff.cdb
fpga2/test1/db/test1.sgdiff.hdb
fpga2/test1/db/prev_cmp_test1.sim.qmsg
fpga2/test1/db/prev_cmp_test1.qmsg
fpga2/test1/db/test1.sim.qmsg
fpga2/test1/db/test1.fit.qmsg
fpga2/test1/db/test1.cbx.xml
fpga2/test1/db/test1.hif
fpga2/test1/db/test1.(0).cnf.cdb
fpga2/test1/db/test1.(0).cnf.hdb
fpga2/test1/db/test1.hier_info
fpga2/test1/db/test1.sld_design_entry.sci
fpga2/test1/db/test1.rtlv_sg_swap.cdb
fpga2/test1/db/test1.cmp0.ddb
fpga2/test1/db/test1.cmp.rdb
fpga2/test1/db/test1.pre_map.hdb
fpga2/test1/db/test1.psp
fpga2/test1/db/test1.dbp
fpga2/test1/db/test1.pss
fpga2/test1/db/test1.pre_map.cdb
fpga2/test1/db/test1.asm.qmsg
fpga2/test1/db/test1.eco.cdb
fpga2/test1/db/prev_cmp_test1.map.qmsg
fpga2/test1/db/test1.sim.hdb
fpga2/test1/db/test1.syn_hier_info
fpga2/test1/db/test1.tan.qmsg
fpga2/test1/db/test1.sim.rdb
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fpga2/test1/db/test1.simfam
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fpga2/test1/db/test1.map.bpm
fpga2/test1/db/prev_cmp_test1.fit.qmsg
fpga2/test1/db/prev_cmp_test1.asm.qmsg
fpga2/test1/db/prev_cmp_test1.tan.qmsg
fpga2/test1/db/test1.sld_design_entry_dsc.sci
fpga2/test1/db/test1.cmp_bb.rcf
fpga2/test1/db/test1.eds_overflow
fpga2/test1/db/wed.wsf
fpga2/test2/test2.qpf
fpga2/test2/test2.qsf
fpga2/test2/test2.vhd
fpga2/test2/test2.map.summary
fpga2/test2/test2.map.rpt
fpga2/test2/test2.flow.rpt
fpga2/test2/test2.done
fpga2/test2/test2.vwf
fpga2/test2/test2.sim.rpt
fpga2/test2/test2.qws
fpga2/test2/db/test2.db_info
fpga2/test2/db/test2.map.qmsg
fpga2/test2/db/test2.cbx.xml
fpga2/test2/db/test2.hif
fpga2/test2/db/test2.(0).cnf.cdb
fpga2/test2/db/test2.(0).cnf.hdb
fpga2/test2/db/test2.hier_info
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fpga2/test2/db/test2.pre_map.cdb
fpga2/test2/db/test2.psp
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fpga2/test2/db/test2.sgdiff.hdb
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fpga2/test2/db/test2.map_bb.cdb
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fpga2/test2/db/test2.map.cdb
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fpga2/test2/db/test2.cmp.rdb
fpga2/test2/db/test2.tis_db_list.ddb
fpga2/test2/db/test2.fnsim.qmsg
fpga2/test2/db/mux_

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