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文件名称:SINADA

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Matlab] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.46mb
  • 已下载：
    0次
  • 提 供 者：
    jing****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

DE2开发板配套的AD/DA子板的驱动程序。-DE2 development board supporting the AD/DA daughter board drivers.
相关搜索： DA

(系统自动生成,下载前可以参看下载内容)

下载文件列表

SINADA/db/add_sub_ecj.tdf
SINADA/db/add_sub_meh.tdf
SINADA/db/prev_cmp_SINADA.asm.qmsg
SINADA/db/prev_cmp_SINADA.fit.qmsg
SINADA/db/prev_cmp_SINADA.map.qmsg
SINADA/db/prev_cmp_SINADA.qmsg
SINADA/db/prev_cmp_SINADA.sim.qmsg
SINADA/db/prev_cmp_SINADA.tan.qmsg
SINADA/db/SINADA.(0).cnf.cdb
SINADA/db/SINADA.(0).cnf.hdb
SINADA/db/SINADA.(1).cnf.cdb
SINADA/db/SINADA.(1).cnf.hdb
SINADA/db/SINADA.(2).cnf.cdb
SINADA/db/SINADA.(2).cnf.hdb
SINADA/db/SINADA.(3).cnf.cdb
SINADA/db/SINADA.(3).cnf.hdb
SINADA/db/SINADA.(4).cnf.cdb
SINADA/db/SINADA.(4).cnf.hdb
SINADA/db/SINADA.(5).cnf.cdb
SINADA/db/SINADA.(5).cnf.hdb
SINADA/db/SINADA.asm.qmsg
SINADA/db/SINADA.asm_labs.ddb
SINADA/db/SINADA.cbx.xml
SINADA/db/SINADA.cmp.bpm
SINADA/db/SINADA.cmp.cdb
SINADA/db/SINADA.cmp.ecobp
SINADA/db/SINADA.cmp.hdb
SINADA/db/SINADA.cmp.kpt
SINADA/db/SINADA.cmp.logdb
SINADA/db/SINADA.cmp.rdb
SINADA/db/SINADA.cmp.tdb
SINADA/db/SINADA.cmp0.ddb
SINADA/db/SINADA.cmp_merge.kpt
SINADA/db/SINADA.db_info
SINADA/db/SINADA.eco.cdb
SINADA/db/SINADA.eds_overflow
SINADA/db/SINADA.fit.qmsg
SINADA/db/SINADA.hier_info
SINADA/db/SINADA.hif
SINADA/db/SINADA.lpc.html
SINADA/db/SINADA.lpc.rdb
SINADA/db/SINADA.lpc.txt
SINADA/db/SINADA.map.bpm
SINADA/db/SINADA.map.cdb
SINADA/db/SINADA.map.ecobp
SINADA/db/SINADA.map.hdb
SINADA/db/SINADA.map.kpt
SINADA/db/SINADA.map.logdb
SINADA/db/SINADA.map.qmsg
SINADA/db/SINADA.map_bb.cdb
SINADA/db/SINADA.map_bb.hdb
SINADA/db/SINADA.map_bb.logdb
SINADA/db/SINADA.pre_map.cdb
SINADA/db/SINADA.pre_map.hdb
SINADA/db/SINADA.rtlv.hdb
SINADA/db/SINADA.rtlv_sg.cdb
SINADA/db/SINADA.rtlv_sg_swap.cdb
SINADA/db/SINADA.sgdiff.cdb
SINADA/db/SINADA.sgdiff.hdb
SINADA/db/SINADA.sim.hdb
SINADA/db/SINADA.sim.qmsg
SINADA/db/SINADA.sim.rdb
SINADA/db/SINADA.sim_ori.vwf
SINADA/db/SINADA.sld_design_entry.sci
SINADA/db/SINADA.sld_design_entry_dsc.sci
SINADA/db/SINADA.syn_hier_info
SINADA/db/SINADA.tan.qmsg
SINADA/db/SINADA.tis_db_list.ddb
SINADA/db/SINADA_global_asgn_op.abo
SINADA/db/wed.wsf
SINADA/FILTER.bsf
SINADA/FILTER.cmp
SINADA/FILTER.html
SINADA/FILTER.qip
SINADA/FILTER.vec
SINADA/FILTER.vhd
SINADA/FILTER.vho
SINADA/FILTER_ast.vhd
SINADA/FILTER_coef_int.txt
SINADA/FILTER_constraints.tcl
SINADA/FILTER_input.txt
SINADA/FILTER_mlab.m
SINADA/FILTER_model.m
SINADA/FILTER_msim.tcl
SINADA/FILTER_nativelink.tcl
SINADA/FILTER_param.txt
SINADA/FILTER_silent_param.txt
SINADA/FILTER_st.v
SINADA/fir_compiler-library/accum.v
SINADA/fir_compiler-library/addr_cnt_dn.v
SINADA/fir_compiler-library/addr_cnt_dn_poly.v
SINADA/fir_compiler-library/addr_cnt_up.v
SINADA/fir_compiler-library/at_sink_mod.v
SINADA/fir_compiler-library/at_sink_mod_bin.v
SINADA/fir_compiler-library/at_sink_mod_par.v
SINADA/fir_compiler-library/at_src_mod.v
SINADA/fir_compiler-library/at_src_mod_par.v
SINADA/fir_compiler-library/auk_dspip_avalon_streaming_block_sink_fir_90.vhd
SINADA/fir_compiler-library/auk_dspip_avalon_streaming_block_source_fir_90.vhd
SINADA/fir_compiler-library/auk_dspip_avalon_streaming_controller_fir_90.vhd
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SINADA/fir_compiler-library/auk_dspip_avalon_streaming_sink_fir_90.ocp
SINADA/fir_compiler-library/auk_dspip_avalon_streaming_sink_fir_90.vhd
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SINADA/fir_compiler-library/auk_dspip_avalon_streaming_source_fir_90.vhd
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SINADA/fir_compiler-library/auk_dspip_fir_coef_banks_fixed_fir_90.vhd
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SINADA/fir_compiler-library/auk_dspip_fir_mult_bank_fir_90.vhd
SINADA/fir_compiler-library/auk_dspip_fir_top_dec_half_sym_fir_90.ocp
SINADA/fir_compiler-library/auk_dspip_fir_top_dec_half_sym_fir_90.vhd
SINADA/fir_compiler-library/auk_dspip_fir_top_dec_sym_add_cas_fir_90.vhd
SINADA/fir_compiler-library/auk_dspip_fir_top_dec_sym_cas_fir_90.oc

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