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文件名称:Viterbi_Verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    3.58mb
  • 已下载：
    1次
  • 提 供 者：
    r****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

viterbi译码的verilog实现,提供相应的原程序代码和testbench

-viterbi decoder verilog implementation
相关搜索： viterbi viterbi decoder in verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

Viterbi_Verilog/
Viterbi_Verilog/BMUwithACSU.v
Viterbi_Verilog/Control.v
Viterbi_Verilog/Delay_16_Cycle.v
Viterbi_Verilog/RAM.v
Viterbi_Verilog/SMUwithOP.v
Viterbi_Verilog/SPECIFICATION.doc
Viterbi_Verilog/SPECIFICATION.pdf
Viterbi_Verilog/Stack.v
Viterbi_Verilog/tb_top.v
Viterbi_Verilog/Top.v
Viterbi_Verilog/答辩讲义.ppt

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