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文件名称:Design_74LS138

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Windows] [程序]
  • 上传时间：
    2012-11-16
  • 文件大小：
    10.73kb
  • 已下载：
    0次
  • 提 供 者：
    stro****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用Active-VHDL 来仿真测试74LS138 译码器，74LS138 译码器是3 线-8 线译

码器。-To the use of Active-VHDL simulation test 74LS138 decoder, 74LS138 decoder is a 3-wire-8 line decoder.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Design_74LS138/Design_74LS138.adf
Design_74LS138/design_74ls138.lib
Design_74LS138/design_74ls138.mgf
Design_74LS138/Generic/contents.lib~
Design_74LS138/Generic/Design_74LS138.erf
Design_74LS138/Generic/Design_74LS138.wsp
Design_74LS138/Generic/Generic.cfg
Design_74LS138/Generic/sources.sth
Design_74LS138/Generic/wave.dat
Design_74LS138/log/compile.log
Design_74LS138/log/console.log
Design_74LS138/log/find.log
Design_74LS138/log/simulation.log
Design_74LS138/src/Design_74LS138.bak
Design_74LS138/src/Design_74LS138.VHD
Design_74LS138/src/Waveform5.awf
Design_74LS138/Generic
Design_74LS138/log
Design_74LS138/src
Design_74LS138

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