文件名称:state-machine
-
所属分类：
- 标签属性：
- 上传时间：2012-11-16
-
文件大小：271.67kb
-
已下载：0次
-
提 供 者：
-
相关连接：无下载说明：别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容来自于网络，使用问题请自行百度
the two pdf describe the state maceine designing with VHDL or Verilog! The examples are very good with your work!
(系统自动生成,下载前可以参看下载内容)
下载文件列表
Designing Safe VHDL State Machines with Synplify.pdf
State machine design techniques for Verilog and VHDL.pdf
State machine design techniques for Verilog and VHDL.pdf
1999-2046 搜珍网 All Rights Reserved.
本站作为网络服务提供者，仅为网络服务对象提供信息存储空间，仅对用户上载内容的表现方式做保护处理，对上载内容本身不做任何修改或编辑。